AMD EPYC „Venice“ mit Zen 6: 256 Kerne, 2nm und mehr Effizienz für HPC
SAN FRANCISCO / LONDON (IT BOLTWISE) – AMD hat auf der „Advancing AI“-Veranstaltung EPYC „Venice“ mit Zen 6 in den Vordergrund gerĂĽckt und dabei vor allem die nächste Größenordnung bei Rechenleistung betont. Der Flagship-Zielwert liegt bei bis zu 256 Kernen und einem Chiplet-Design mit vielen Compute- und getrennten I/O-Dies. Entscheidend fĂĽr Rechenzentren ist zudem der […]
MPLAB XC Compiler von Microchip: Toolchain fĂĽr PIC- und SAM-Projekte
LONDON (IT BOLTWISE) – Microchip bĂĽndelt mit den MPLAB XC Compilern eine optimierte C- und C++-Toolchain speziell fĂĽr PIC- und SAM-Mikrocontroller. Die XC8-, XC16- und XC32-Varianten sind eng an die MPLAB X IDE gekoppelt, inkl. Debug-Workflow mit Breakpoints und Live-Register-Ansicht. Je nach Lizenzstufe reichen die Unterschiede von kostenfreier Free-Edition bis zu PRO-Versionen mit erweiterten Optimierungen […]
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