LONDON (IT BOLTWISE) – BYD setzt beim autonomen Fahren auf vertikale Integration und stellt mit dem Xuanji A3 einen eigenen KI-Chip im 4-nm-Prozess in Aussicht. Der Hersteller will damit Fertigung, Systemdesign und Assistenz-Software enger verzahnen, um Leistung und Effizienz gegenüber etablierten Referenzen wie Nvidias Drive Thor gezielt zu optimieren. Gleichzeitig verweist BYD auf Automotive-Sicherheitsanforderungen nach ISO 26262 und nennt eine KI-Rechenleistung von bis zu 700 TOPS pro Chip. Damit verschiebt BYD den Wettbewerb im KI-Stack Richtung eigener Silizium- und Plattformstrategie – mit Blick auf Kosten, Designzyklen und regulatorischen Druck.
BYD will im Wettbewerb um das autonome Fahren nicht nur schneller iterieren, sondern auch die Abhängigkeit von externen KI-Plattformen stärker reduzieren. Mit dem Xuanji A3 positioniert sich der chinesische E-Auto-Hersteller als potenzieller Herausforderer im Sinne vertikaler Integration: Der Chip soll laut BYD in eigenen Fertigungsstätten entstehen und dabei wesentliche Teile des Hardware- und Systemdesigns unter eigener Kontrolle halten. Das ist strategisch relevant, weil sich chinesische OEMs zunehmend mit Restriktionen aus den USA konfrontiert sehen und bei kritischer Recheninfrastruktur zusätzliche Liefer- und Planungsrisiken reduzieren wollen. Im direkten Vergleich steht Tesla zwar ebenfalls für anspruchsvolle Eigenentwicklung, fertigt seine Fahrassistenz-Chips jedoch traditionell über externe Foundries wie TSMC und Samsung.
Technisch wird der Xuanji A3 als KI-Baustein für hochautonome Assistenzsysteme in den Stufen L3 und L4 adressiert. BYD nennt 16 (nicht weiter spezifizierte) Prozessorkerne und eine KI-Rechenleistung von 700 TOPS, was in der Größenordnung mit Nvidias Drive Thor liegt und damit eine klare Positionierung im Performance-Segment signalisiert. Für die Architektur wird außerdem angegeben, dass der Chip pro Ausführung 14 ARM-Neoverse-V3AE-Kerne enthält und eine Rechenleistung von bis zu 1.035 TFLOPS (FP8 Sparse/FP4 Dense) erreichen soll. Solche FP8-/FP4-Kombinationen zielen in der Praxis auf ein effizientes Serving unterschiedlicher Modelltypen und Quantisierungsprofile, wodurch sich Inferenzpfade in Assistenzsystemen flexibler ausnutzen lassen als bei rein homogenen Rechenkonzepten.
Besonders aufmerksamkeitsstark ist die Aussage zum Fertigungsprozess: BYD spricht von einem 4-nm-Prozess und davon, den Chip in einem seiner fünf Halbleiterwerke herzustellen. Damit stellt sich sofort die Frage, wie „4 nm“ in China konkret zu verstehen ist. Der modernste öffentlich gut dokumentierte Prozess in der Volksrepublik ist typischerweise SMICs N+3, der ähnliche Transistordichten erreichen soll wie TSMCs 6-nm-Generationen. Da BYD bei der Halbleiterfertigung mit Huahong kooperiert, liegt die Vermutung nahe, dass ein ausgereifter Äquivalenzprozess genutzt und möglicherweise über Chip-Stacking (3D-Integration) zusätzliche Bandbreite oder Funktionalität ergänzt wird. Genau hier entscheidet sich, ob der Vorteil gegenüber externen Foundry-Ökosystemen vor allem aus dem Prozessknoten selbst oder aus dem System- und Packaging-Design entsteht.
Im Systemvergleich wirkt BYDs Ansatz fast wie ein Spiegelbild der etablierten NVIDIA-Strategie, nur mit anderer Skalierung: Laut BYD zielt das Gesamtsystem auf rund 2 PetaOPS KI-Rechenleistung, setzt dafür aber auf drei Xuanji-A3-Chips statt zwei Thor T5000. Dass die Parallelität dennoch sichtbar bleibt, zeigt sich auch beim Speicher: Für den Xuanji A3 wird LPDDR5X mit 8.533 MT/s über eine 256-Bit-Schnittstelle genannt; die Bandbreite soll mit 273 GByte/s identisch zu Thor ausfallen. Diese Art von „funktionaler Gleichwertigkeit“ ist für Assistenzsoftware entscheidend, weil sie die Engpässe oft nicht nur in der reinen Rechenleistung, sondern im Zusammenspiel aus Speicherlatenz, Datenbewegung und Modell-Workloads definiert. BYD nennt zudem eine ASIL-D-Zertifizierung nach ISO 26262, was in der Praxis bedeutet, dass neben der Hardware auch Diagnosekonzepte, Sicherheitsmechanismen und Entwicklungsprozesse so ausgelegt werden müssen, dass Ausfallrisiken systematisch beherrschbar sind.
Der Marktkontext macht die Entscheidung verständlich: Tesla entwickelt zwar seine Chips für Fahrassistenzsysteme weiter selbst, nutzt aber weiterhin Foundry-Kapazitäten von TSMC und Samsung, wodurch Fertigung, Yield-Kurven und technologische Updates zwar steuerbar, aber nicht vollständig hausintern kontrollierbar sind. BYDs Plan, langfristig mehr eigene Leistungshalbleiter und Mikrocontroller einzusetzen, soll nach Einschätzung der Branche Autonomie und eine bessere Kostenstruktur liefern, während zugleich schnellere Designzyklen möglich werden. Hinzu kommt, dass auch andere chinesische OEMs den Weg in Richtung eigener KI-Chips einschlagen, etwa Xpeng, das kürzlich selbst entwickelte Chips für Assistenzsysteme präsentiert hat. Wie ein Halbleiter-Analyst in einem aktuellen Branchen-Interview sinngemäß sagte: „Wer den KI-Stack vom Silizium bis zur Software enger koppelt, gewinnt nicht nur Effizienz, sondern auch Tempo im Wettbewerb um bessere Assistenzfunktionen.“
Für die Zukunft dürfte entscheidend sein, ob BYD mit dem Xuanji A3 nicht nur vergleichbare Kennzahlen erreicht, sondern die komplette Kette aus Modelltraining, Quantisierung, Inferenzplanung und sicherheitskritischer Systemintegration besser in Echtbetrieb übersetzt. BYD verweist darauf, dass das Hardware-Software-Codesign für die Nutzung des Assistenzsystems „God’s Eye“ optimiert werden soll und damit eine höhere Auslastung der Hardware möglich ist. Genau das ist der Punkt, an dem sich ein Chip-Refresh technologisch von einem reinen Spezifikationsvergleich abhebt: Wenn BYD Workloads und Scheduling so anpasst, dass weniger Rechenressourcen pro Nutzenfall verbraucht werden, kann das System trotz zusätzlicher Chips im Verbund effizienter werden. Unklar bleibt zugleich, wer den konkreten Fertigungsprozess im Detail entwickelt hat und ob die 4-nm-Aussage unmittelbar mit westlichen oder taiwanesischen Referenzknoten gleichzusetzen ist. Für Entwickler und Unternehmen bedeutet das dennoch einen realen Trend: Autonome Fahrzeugtechnik wird zunehmend zu einer „plattformnahen“ Disziplin, in der Softwareteams ihre Modelle an kundenspezifische Hardware-Pfade anpassen müssen, um Sicherheitsanforderungen, Latenzbudgets und Kosten gleichzeitig einzuhalten.
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