ARIZONA / LONDON (IT BOLTWISE) – TSMC meldet eine Rekordnachfrage nach dem N3-Fertigungsprozess und weist darauf hin, dass zentrale Kapazitäten für 2026 bereits vergeben sind. NVIDIA und Google treiben den Bedarf mit neuen KI-Bausteinen (GPUs und TPUs) zusätzlich an und sichern sich damit vorausschauend Produktionsslots. Für die Branche entsteht dadurch ein Engpass, der Unternehmen zu Umschulungen und Alternativen beim Packaging und bei Fertigungspartnern zwingt. Gleichzeitig bleibt offen, wie schnell zusätzliche N3-Umrüstungen aus bestehenden Linien den Versorgungsdruck im Jahr 2027 entschärfen.
Der Engpass bei TSMCs N3-Prozess ist längst mehr als ein Tabellenproblem in der Chip-Planung. Laut den vorliegenden Marktangaben sind die sogenannten N3-Knoten für das Jahr 2026 bereits ausverkauft, während auch die Produktion für 2027 im Kernjahrgang vollständig belegt sein soll. Das bedeutet praktisch: Wer seine KI-Systeme, Beschleunigerkarten oder Server-Backends auf neue Architektur-Generationen ausrichten will, muss die Lieferkette so früh wie möglich absichern – selbst dann, wenn die eigenen Produkte erst später ausgeliefert werden.
Für TSMC selbst spiegelt sich die Nachfrage in den Geschäftszahlen wider. Im zweiten Quartal 2026 nennt das Unternehmen einen Umsatz von 40,2 Mrd. USD, das entspricht einem Plus von 33,7 % gegenüber dem Vorjahreszeitraum. Der Nettogewinn steigt um 77,4 % auf 22,4 Mrd. USD. Parallel dazu werden die Investitionsausgaben für das laufende Jahr auf 60 bis 64 Mrd. USD angehoben und zudem Preisanpassungen von bis zu 10 % für 2027 in Aussicht gestellt – ein Hinweis darauf, dass die Preisbildung zunehmend vom Kapazitätsangebot und weniger von der reinen Nachfragekurve getrieben wird.
Mit der Kapazitätslogik verändert sich auch der Charakter der Fertigung: Statt nur neue Wafer-Starts zu planen, rückt die Umrüstung bestehender Linien in den Fokus. TSMC will dem Bericht zufolge bestehende N5-Kapazitäten innerhalb von sechs bis zwölf Monaten auf N3 umstellen, um die Lücke zumindest teilweise zu schließen. Gleichzeitig zeigt die regionale Strategie nach außen, wie eng Produktion, Forschung und nachgelagerte Prozessschritte miteinander gekoppelt sind: In Arizona werden die Investitionen um 100 Mrd. USD auf insgesamt 265 Mrd. USD erhöht. Dort sollen zwölf Fabriken entstehen, ergänzt um Bereiche für Forschung und Entwicklung sowie Anlagen für Advanced Packaging, während die Inbetriebnahme einer N3-spezialisierten Fabrik 2 für die zweite Jahreshälfte 2027 erwartet wird.
Während TSMC an mehreren Hebeln arbeitet, verschärfen NVIDIA und Google den Wettbewerb um die verbleibenden Slots. NVIDIA plant, seine Rubin-GPUs auf den N3-Standard umzustellen, Google setzt bei seinen Tensor Processing Units (TPU) ebenfalls auf Fertigung im N3-Verfahren (genannt werden v7 und v8). Für NVIDIA ist der Zugang nicht nur strategisch, sondern auch vertraglich relevant: Das Unternehmen muss Lieferverpflichtungen in Höhe von 124 bis 145 Mrd. USD bis 2027 erfüllen. Dass hier zusätzlich Packaging- und Testkapazitäten in den USA eine Rolle spielen sollen, unterstreicht: Nicht nur die Waferproduktion, auch die „letzten Meilen“ der Chip-Herstellung entscheiden darüber, wann aus Silizium echte Systeme werden.
Genau dort wird die Bedeutung von CoWoS (Chip-on-Wafer-on-Substrate) sichtbar. TSMC will die Ausbringungsmenge im Packaging bis Ende 2026 auf 130.000 Wafer pro Monat steigern; dennoch bleiben laut Bericht auch diese Kapazitäten für 2027 bereits vergeben. Das ist für Unternehmen entscheidend, die KI-Cluster in kurzer Zeit ausrollen: Selbst wenn das Frontend – also das Wafer-Fertigen – rechnerisch verfügbar wäre, können fehlende Packaging-Slots die Lieferfähigkeit ausbremsen. Zudem ist zu beachten, dass moderne KI-Bausteine häufig auf hochbandbreitenspezifische Speicherprofile wie HBM4 ausgerichtet sind; damit steigt der Druck, dass Packaging- und Testketten diese Anforderungen zuverlässig mittragen.
Der Engpass erklärt auch, warum alternative Fertigungspartner nicht „einfach einspringen“ können. Ein Versuch von NVIDIA, den 18A-Prozess von Intel zu nutzen, wird im Bericht zunächst als gestoppt beschrieben, weil die Ausbeute (Yield) noch nicht das nötige Niveau erreichen soll. Zwar werden in Intels Fabrik 52 in Arizona 18A-Kapazitäten angeboten, doch gleichzeitig sucht Intel offenbar weiterhin nach stabilen Kundenbeziehungen für diese Technologie. In Taiwan wiederum laufen Vorbereitungen für neue TSMC-Fabriken im ersten Halbjahr 2027, um die globale Abhängigkeit von begrenzten N3-Ressourcen mittelfristig abzumildern.
Für die nächsten Monate ergibt sich daraus ein klarer operativer Schwerpunkt: Wer auf neue KI-Hardware setzt, plant nicht nur Architektur- und Software-Roadmaps, sondern auch Fabrik- und Packaging-Roadmaps. Das gilt besonders, weil leistungsfähige KI-Systeme zunehmend mit strengen Vorgaben verknüpft sind und Risiken im Betrieb sowie bei der Dokumentation für viele Unternehmen spürbar werden. Angesichts der Knappheit wird außerdem plausibler, warum sich Einkaufs-, Rechts- und Engineering-Teams enger verzahnen müssen: Lieferfähigkeit, technische Spezifikation und Compliance-Anforderungen laufen in der Praxis an denselben Projektmeilensteinen zusammen – und lassen sich nicht sauber voneinander entkoppeln, wenn die Zeitpläne bereits 2026 eng getaktet sind.
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