LONDON (IT BOLTWISE) – AMD schafft mit einer neuen Patch-Serie im Linux-Kernel eine dritte Kernklasse für x86-Topologien: einen Low-Power-Core. Damit kann das Betriebssystem Idle- und Hintergrund-Workloads künftig präziser auf sehr stromsparende Einheiten verteilen. Der Schritt passt zu den erwarteten Zen-6-LP-Designs in Medusa-APUs und wirft zugleich ein Licht auf das Scheduler-Handling im Vergleich zu Intels Ansatz bei Nova Lake-S.

AMD zieht den nächsten Schraubendreher an seiner heterogenen CPU-Planung an: Im Linux-Kernel wird eine neue x86-Kernklassifizierung eingezogen, die unterhalb der bekannten Performance- und Efficiency-Kerne liegt. Linux soll dadurch nicht nur zwischen schnellen und „mittleren“ Kernen unterscheiden, sondern zusätzlich sehr sparsame Low-Power-Cores korrekt erkennen. Das klingt nach Verwaltungsarbeit, ist in der Praxis aber entscheidend für Reaktionszeiten, Energieverbrauch und thermisches Verhalten im Leerlauf. Konkret adressiert der neue Kern-Typ Workloads, die früher oft zu häufig auf zu leistungsfähigen Einheiten landeten.
Technisch erweitert die Patch-Serie die Topologie-Logik über ein neues cpu_type-Schema: neben Performance- und Efficiency-Kerne kommt ein dritter Low-Power-Core-Typ hinzu. Der Wert wird über das CPUID-Leaf „Fn0x80000026“ gemeldet; im Patch wird entsprechend auch ein „Wert 2“ als Kennung für den Low-Power-Kern beschrieben. Der Vorteil für den Kernel-Stack liegt im Codeumfang und in der eindeutigen Typ-Zuordnung: Ohne diese Logik würden solche Kerne potenziell als „unbekannt“ behandelt. Vishal Badole, der die Serie einreicht, betont dabei vor allem, dass Linux die Prozessorkerne korrekt einordnet, statt sie falsch zu klassifizieren.
Einordnung und Architektur-Semantik sind dabei mehr als nur eine Namensänderung. Zen 6 LP wird als dritte und sparsamste Ebene in AMDs Kernhierarchie positioniert, unterhalb der dichten Zen-6c-Kerne. Zen-6c wiederum nutzt laut bisherigen Leaks/Einordnungen dieselbe Grundarchitektur wie klassische Zen-6-Kerne, ist aber „dichter“ gepackt und erhält weniger L3-Cache. Für Low-Power bedeutet das im Scheduler-Kontext: Linux darf die Boost- und Platzierungslogik anders gewichten als bei Efficiency-Kernen. Diese Trennung ist relevant, weil Boost-Skalierung und Priorisierung bei heterogenen Systemen sonst schnell zu einem falschen Energieregime führen.
Wie stark der Low-Power-Effekt ausfällt, hängt von den erwarteten Hardware-Rahmendaten ab. Kursierende Angaben ordnen Zen-6-LP-Kerne typischerweise paarweise ein und nennen für sie Zugriff auf 512 KiB L2-Cache sowie 2 MiB L3-Cache. Bei der Pro-Takt-Leistung wird dabei grob ein Korridor zwischen Zen 3 und Zen 4 diskutiert, während moderate Taktraten im Bereich von 2,5 bis 3,5 GHz im Raum stehen. Wichtig ist: Die Patch-Serie nennt keine konkreten Produktnamen wie „Medusa“ oder „Ryzen X“. Dennoch wirkt die Engineering-Richtung konsistent, weil der Kernel-Support genau dort ansetzt, wo die Topologie-Auswertung sonst aussetzt.
Im Marktbild verdichtet sich der Zusammenhang zu den erwarteten Medusa-APUs: Viele Leaks verorten Zen 6 LP zunächst in integrierten Plattformen, während Desktop-Varianten zwar möglich, aber weniger gesichert sein sollen. Für die mobilen und integrierten Ableger wird eine Konfiguration diskutiert, die aus vier klassischen Zen-6-, vier dichten Zen-6c- und zwei Low-Power-Kernen besteht, ergänzt um eine RDNA-4m-Grafikeinheit. Über Geekbench-Einträge werden Modelle mit insgesamt zehn Prozessorkernen als möglich beschrieben. Auf diesen Punkt treffen sich technische Realitäten und Timing: Da Zen-6-LP-Kerne als eigene Typklasse abgebildet werden, wird die Software-Seite im Takt mit der Plattformreife greifbar.
Genau hier wird der Wettbewerbsvergleich interessant. Intel verfolgt mit Nova Lake-S einen anderen Weg, bei dem dem Gegenentwurf eine sehr große Zahl an Prozessorkernen gegenübersteht: laut Berichten bis zu 52 Kerne im Premium-Workload-Segment. Die sparsameren LPE-Kerne waren bei Intel offenbar erst später wirklich „stimmig“ im Design, etwa mit größerem L2-Cache und einem zusätzlichen Memory-Side-Cache, und die Kernflut weckte zunächst selbst bei Idle immer wieder Performance-Kerne. AMDs Ansatz scheint hingegen weniger auf schiere Kernzahl zu setzen, sondern darauf, Idle- und Hintergrundlasten effizient zu bedienen, ohne eine zweite, vollständig getrennte Kernarchitektur als „neuen Produktstack“ pflegen zu müssen. Für das Scheduling heißt das: beide Hersteller erhöhen die Heterogenität, aber AMDs Linux-Ready-Topologie gibt dem Betriebssystem eine klarere Entscheidungsgrundlage.
Unter professionellen Betriebssystemen wie Linux funktioniert diese Art Differenzierung in der Regel früher und stabiler als unter Windows, weil Kernel-Subsysteme wie CPU-Freq, Energy-Aware Scheduling und Topology-Parsing stärker auf konkrete Typen reagieren können. Das bedeutet nicht, dass Windows „nicht kann“, aber die Praxis zeigt: Sobald ein Kernel-Release die korrekten CPUID-Infos und Typ-Semantik bereitstellt, können Distributionen und Toolchains ihre Heuristiken schneller nachziehen. Die Konsequenz ist messbar: Besseres Zuordnen von Hintergrund-Tasks auf Low-Power-Einheiten reduziert Energieverbrauch und senkt die Wahrscheinlichkeit, dass das System unnötig in höhere Boost-States gerät. Für Unternehmen ist das relevant, weil Server-, Admin- und Entwickler-Workloads oft viele kleine, dauerhafte Hintergrundaktivitäten haben.
Ausblickend stellt sich die Frage, wann Zen-6-LP tatsächlich in der Breite auf Produktseite ankommt. Ein konkretes Datum wird nicht genannt; die erwarteten Medusa-APUs werden um die CES 2027 eingeordnet. Für Desktop-Varianten ist der Nutzen hingegen noch unklar: Wenn Low-Power-Cores zwar vorhanden sind, aber nicht im gleichen Maß die typischen Idle-Muster adressieren, kann der Mehrwert geringer ausfallen. Gleichzeitig wird die Software-Seite mit jedem Kernel-Release ein Stück „vorhersehbarer“: Sobald Linux den Low-Power-Core-Typ sauber verarbeitet, können Entwickler, Scheduler-Tuning und Monitoring-Tools genauer planen. Für die KI- und Virtualisierungs-Ökosysteme ergibt sich daraus eine leise, aber praktische Chance: Idle- und Nebenlasten werden weniger teuer, während echte Rechenphasen weiterhin auf performantere Kerne optimiert bleiben.
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