SAN FRANCISCO / LONDON (IT BOLTWISE) – Auf der Advancing AI 2026 stellt AMD die Plattform Helios vor und kombiniert dafür Zen-6-Server-CPUs mit CDNA-5-Beschleunigern. Im Kern steht die Instinct MI455X mit 432 GiB HBM4 und 40 PetaFLOPS bei MXFP4. Die Racks sollen damit nicht nur einzelne Chips liefern, sondern CPU, Netzwerk und Software als Gesamtpaket adressieren. Offen bleibt, ob Helios im Praxisvergleich die Effizienzvorteile gegenüber vergleichbaren Systemen tatsächlich erreicht.
AMD setzt auf der Advancing AI 2026 in San Francisco gleich an zwei Stellen an, die in KI-Rechenzentren oft über Jahre dominieren: Rechenleistung pro Watt und Speicherbandbreite pro Modell-Iteration. Mit Zen 6 (Epyc 9006, alias Venice) liefert der Chipriese die Server-CPU-Basis; mit CDNA 5 (Instinct MI455X) kommt die KI-„GPU“-Schicht dazu. Zusammen sollen sie in Helios enden, einem Komplettsystem für große Trainings- und Inferenz-Workloads. Die Richtung ist klar: Nicht nur ein neuer Beschleuniger, sondern eine abgestimmte Plattform, die sich in Planung, Skalierung und Betrieb möglichst nahtlos in bestehende Rechenzentrumsprozesse integrieren lässt.
Bei Zen 6 dreht sich vieles um die Frage, wie viele Kerne und wie viel Taktrate AMD in einem Server-Design unterbringt, ohne die Flächen- und Energieeffizienz zu verlieren. An der Spitze steht der Epyc 9996 mit bis zu 256 Zen-6c-Kernen und 512 Threads. Zen 6c ist dabei keine separate Effizienzarchitektur wie Intels E-Cores, sondern eine kompaktere Zen-6-Variante, bei der AMD die Kerndichte und den Flächenbedarf optimiert. Daneben existieren „reguläre“ Zen-6-Ausführungen mit bis zu 96 Kernen und Taktraten von bis zu 5,0 GHz. Für Spezialkonfigurationen plant AMD zusätzlich Epyc 9006X mit bis zu 1.152 MiByte L3-Cache und bis zu 5,15 GHz, wobei dieses X-Design auf 3D V-Cache setzt.
Das ist für den Desktop nicht direkt übertragbar, liefert aber wichtige Indizien für kommende Ryzen-Generationen. AMD beschreibt Zen 6 explizit in zwei Zielen: maximaler Kerndichte und Auslegung auf Leistung um die 5-GHz-Marke. Gleichzeitig wird an 3D V-Cache festgehalten, was die Brücke zu Ryzen-X3D-CPUs schlägt: Deren Vorteil in vielen Spielen hängt nicht an höheren Taktraten allein, sondern daran, dass ein sehr großer Cache die Lastspitzen abfedert und Speicherzugriffe reduziert. Für Spieler bleibt dennoch vieles offen, weil die desktoprelevanten Kennzahlen wie IPC-Zuwachs, konkrete Ryzen-Kernzahlen, CCD-Aufbau und Spieleleistung noch nicht konkretisiert sind. Spannend bleibt außerdem die Server-Plattform: 16 Speicherkanäle, MRDIMMs mit 12.800 MT/s und PCIe 6.0. Letzteres verdoppelt gegenüber PCIe 5.0 die potenzielle Übertragungsrate und wird im Server vor allem für den Durchsatz zwischen Beschleunigern, Netzwerkkarten und schnellen Massenspeichern relevant.
Auf der „GPU“-Seite übernimmt die Instinct MI455X die Rolle des neuen KI-Spitzengeräts. AMD positioniert CDNA 5 nicht als direkten Nachfolger von RDNA, sondern als parallelen Grafik- und Rechenschaftszweig: RDNA bleibt für Spiele, Grafik und Raytracing gedacht, CDNA für KI und wissenschaftliche Berechnungen. Die Nummerierung folgt damit nicht 1:1 einem festen zeitlichen Schema, denn CDNA 1 kam beispielsweise erst kurz nach RDNA 2; die Abstände zwischen den Generationen variieren. Für CDNA 5 nennt AMD als Fertigung 2 nm, plus 320 Milliarden Transistoren und den Einsatz der neuen CDNA-5-Architektur. Die MI455X erhält 432 GiB HBM4 und erreicht eine Speicherbandbreite von 23,3 TByte/s. Rechenleistung beziffert AMD mit 40 PetaFLOPS bei MXFP4; MXFP4 setzt auf vier Bit pro Zahl und ist damit auf extrem viele KI-Operationen in Trainings- und Inferenzpipelines ausgelegt.
Im Vergleich zur Vorgängergeneration MI355X verspricht AMD konkrete Sprünge: 50 Prozent mehr Speicher, das 2,9-fache an Speicherbandbreite und deutlich mehr Rechenleistung insbesondere bei niedrigen Genauigkeiten, die in vielen KI-Workflows den Alltag dominieren. Gleichzeitig ist das Skalierungsziel bei der Hardware nicht nur ein Datenblatt-Thema, sondern ein Engineering-Problem: Wenn HBM4 neben den Recheneinheiten sitzt, entscheidet die gesamte Systemarchitektur darüber, ob Bandbreite und Latenz auch unter Lastspitzen stabil bleiben. Genau hier setzt Helios an, dem neuen Komplettsystem: Pro Rack kommen 72 Beschleuniger zusammen, insgesamt rund 31 TByte HBM4 und bis zu 2,9 ExaFLOPS bei FP4. Dazu kommen Epyc als Host-CPUs, Pensando als Netzwerkkomponente und ROCm als Softwarebasis. AMD will damit Nvidia nicht primär auf Chip-Ebene verdrängen, sondern mit CPU, Beschleunigern, Netzwerk und Software als zusammenhängendes Paket auftreten.
Auch die Markt-Story versucht AMD messbar zu machen. Auf dem Papier nennt AMD eine um 15 Prozent höhere theoretische FP4-Leistung, 50 Prozent mehr Speicher und bis zu 30 Prozent mehr Tokens pro Dollar im Vergleich zu einem vergleichbaren Vera-Rubin-System. Tokens sind die „Textbausteine“, die ein Modell verarbeitet oder ausgibt; je mehr Tokens ein System pro investiertem Dollar bewältigt, desto günstiger lassen sich typische AI-Workloads in der Rechnung pro Trainingseinheit oder pro Inferenzpaket durchführen. Entscheidend ist aber die Einschränkung: Das sind Herstellerangaben, und AMD rechnet dabei mit eigenen Modellannahmen und öffentlich verfügbaren Nvidia-Daten. Ob Helios im direkten Praxistest die versprochenen Vorteile unter realen Frameworks, Sequenzlängen und Datensätzen reproduziert, bleibt daher eine Frage, die sich nur über Benchmarks in echten Workloads beantworten lässt.
Die größte Hürde für AMD liegt zudem nicht in der Hardware allein, sondern im Software-Ökosystem. In vielen KI-Stacks ist CUDA zum Standard geworden, weil zahlreiche Anwendungen und Libraries explizit dafür optimiert wurden. Entwickler, die von CUDA weg wollen, müssen Portierungsaufwand einplanen, sei es bei Kernels, Bibliotheken oder Performance-Tuning. Andrew Dieckmann, Leiter der Data-Center-GPU-Sparte bei AMD, adressiert genau diesen Punkt: Er beschreibt, dass er inzwischen „praktisch keine Gespräche mehr“ mit großen Kunden über CUDA führe, weil sich die Entwicklung zunehmend auf höhere Abstraktionsebenen und verbreitete Frameworks verlagert. Außerdem sollen Tools wie Codex oder Code-Assistenten 2026 spürbar dabei helfen, Code leichter auf AMD-Hardware anzupassen und zu optimieren. AMDs Gegenstrategie zielt damit weniger auf eine geschlossene CUDA-Kopie als auf ROCm, offene Standards und KI-Assistenten, die einen Teil der Portierungsarbeit reduzieren.
Für die Roadmap plant AMD jährlich eine neue Instinct-Generation: 2026 MI400 mit CDNA 5, 2027 MI500 mit CDNA 6 und 2028 „CDNA Next“. Parallel soll der Ausbau von HBM, KI-Datentypen und der Rack-Vernetzung voranschreiten. Dabei betont AMD, dass Helios mehr als eine Technikdemo sein soll: Laut den Kundenankündigungen planen OpenAI, Meta und Anthropic Installationen im Gigawatt-Maßstab, zusätzlich werden Microsoft und Oracle genannt; insgesamt erwartet AMD über das kommende Jahr mehrere Gigawatt ausgelieferter Helios-Infrastruktur. Für Unternehmen im Rechenzentrumsumfeld heißt das: Der Wettbewerb verlagert sich stärker in die System- und Betriebsebene. Wer in den nächsten Jahren KI-Cluster aufbaut, wird nicht nur die Peak-Zahlen vergleichen, sondern auch prüfen, wie gut CPU-Host, Beschleuniger, Netzwerk und Software im Zusammenspiel funktionieren – genau dort will AMD mit Helios ansetzen.
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