VELDHOVEN / LONDON (IT BOLTWISE) – Samsung und TSMC nehmen ASMLs High-NA-EUV-Lithografie in ihre Roadmaps auf, um künftig komplexere Chips für KI-Anwendungen herzustellen. High-NA-EUV kann deutlich feinere und detailreichere Muster auf Siliziumwafer belichten als frühere Systeme. Für High-NA nennt die Branche Investitionshöhen, die sich laut Quelle grob im zweistelligen Milliardenbereich pro Installationswelle bewegen können. Offen bleibt der konkrete Rollout-Plan von ASML, doch die ersten Kundenfestlegungen erhöhen den Planungsdruck bei Kapazitäten.
Die Verpflichtungen von Samsung und TSMC gegenüber ASMLs High-NA-EUV-Lithografie wirken wie ein deutliches Signal an den gesamten Halbleiter-Maschinenbau: Wenn KI-Workloads mehr Rechenleistung in immer kleineren Strukturen verlangen, verschieben sich die Engpässe dorthin, wo Belichtungssysteme das Layout überhaupt erst „drucken“ können. ASMLs High-NA-Systeme sind dafür der zentrale Hebel, weil sie auf den Wafern kleinere und zugleich komplexere Schichtmuster abbilden als Standard-EUV-Setups. Damit wird die nächste Generation der Fertigungstechnologie nicht nur theoretisch diskutiert, sondern über Kundenentscheidungen in konkrete Kapazitäts- und Technologiezyklen übersetzt.
Technisch betrachtet entscheidet bei EUV-Lithografie weniger die reine Lichtquelle als das gesamte Optik- und Abbildungsprinzip. High NA („High Numerical Aperture“) erhöht die numerische Apertur der optischen Strecke und erlaubt dadurch eine feinere Fokussierung sowie eine bessere Auflösung bei schwierigen Mustergeometrien. Im Produktionsprozess werden diese Muster anschließend genutzt, um in Schritten über verschiedene Prozesslagen die eigentlichen Strukturen im Chip zu formen. Die Quelle nennt als Größenordnung, dass ein High-NA-System rund 400 Millionen US-Dollar kosten kann, was erklärt, warum Hersteller und Zulieferer sehr genau prüfen, wie viele Werkzeuge sie wann installieren können.
Bei Samsung liegt der Fokus auf Speicher: Der Konzern will ASMLs High-NA-Maschinen ab 2028 einsetzen, um DRAM zu produzieren. Zusätzlich plant Samsung, die Technologie ab 2030 schrittweise zu übernehmen und dabei „den DRAM scaling roadmap“ zu erweitern sowie den Prozess effizienter zu machen. Für den Markt ist das relevant, weil DRAM und Logik in KI-Servern oft gemeinsam die Engpasskosten bestimmen: Wird Speicher schneller und günstiger skaliert, sinkt tendenziell der Systemdruck, der durch steigende Rechen- und Datenraten entsteht. TSMC ergänzt diese Logik mit einem Blick auf fortgeschrittene Logik-Chips und erwartet, dass der Einsatz von High-NA-Systemen vor allem durch „zunehmend komplexe Transistorarchitekturen“ für KI getrieben wird.
Für ASML selbst ergibt sich daraus mehr als nur eine Schlagzeile: Die Quelle beschreibt, dass Investoren den Erfolg der High-NA-EUV-Maschinen als Schlüssel für weiteres Wachstum ansehen. Gleichzeitig bleibt ein wichtiger Punkt offen, nämlich wie viele High-NA-Systeme ASML konkret verkaufen will. ASML hat jedoch signalisiert, dass man bis 2027 etwa 30% zusätzliche Kapazität für EUV insgesamt aufbauen möchte. In einer solchen Situation werden Kundenankündigungen wie die von Samsung und TSMC zu einem Planungswerkzeug für die nächsten Quartale: Wenn die Nachfrage bereits „oben“ in der Kundenpipeline sichtbar wird, kann ASML die Auslieferungsreihenfolge und den Ausbau der Produktionslinie für Komponenten (Optik, Teilbaugruppen, Service-Kapazitäten) realistischer kalkulieren.
Auch für den Wettbewerb innerhalb der Chipfertigung ist der Zug klar: Samsung und TSMC schließen sich laut Quelle Intel als Kunden für die High-NA-EUV-Technologie an. Intel hatte bereits im Juli signalisiert, dass High-NA-EUV für fortgeschrittene Chipfertigung genutzt wird. Darüber hinaus rückt ein zweiter Technologiepfad in den Fokus: TSMC und Samsung wollen gemeinsam mit ASML in einer Brancheninitiative die nächste Generation von 12-Zoll-Photomasken vorantreiben. Photomasks sind im Grunde die Schablonen, mit denen die Muster auf die Wafer übertragen werden; der Umstieg von 6-Zoll auf 12-Zoll zielt auf höhere Produktivität und niedrigere Chipfertigungskosten. Gerade weil Photomasks die Skalierung entlang der gesamten Litho-Kette betreffen, kann diese „Nebenbaustelle“ zur Hauptstrecke werden, sobald High-NA-Systeme in breiterem Umfang installiert sind.
Für Unternehmen, die KI-gestützte Systeme entwickeln oder betreiben, ist die Nachricht vor allem indirekt, aber nicht unwichtig. Sie zeigt, dass Künstliche Intelligenz nicht nur neue Software-Modelle hervorbringt, sondern auch die physische Fertigungslandschaft beschleunigt: Wo AI-Modelle komplexere Transistoren benötigen, steigt die Nachfrage nach präziserer Lithografie, und damit nach Werkzeugen, die in der Praxis die nächsten Strukturgrößen überhaupt realisierbar machen. Gleichzeitig entsteht ein Erwartungsdruck auf die Lieferkette aus Maschinenbau, Photomasken-Ökosystem und Fertigungsplanung. Wenn Kapazitäten und Prozessfenster zusammenpassen, profitieren am Ende nicht nur einzelne Chipfamilien, sondern auch die Time-to-Market-Zyklen für KI-Produkte, weil die Hardware-Roadmaps enger an den Software-Fortschritt gekoppelt werden.
Für die weitere Entwicklung bleibt spannend, wie sich das Auftrags- und Auslieferungstempo von ASML konkret in Umsatz und Kapazitätsbelegung übersetzt. Die Quelle erwähnt, dass ASML keine aktuelle Prognose zur Zahl der geplanten Verkäufe abgegeben hat, aber dennoch bereits Ausbauziele für EUV genannt werden. Die nächsten Entscheidungen dürften weniger die reine Technologieentscheidung betreffen, sondern die industrielle Umsetzung: Wie schnell lassen sich High-NA-Systeme in fab-nahe Abläufe integrieren, welche Service- und Optimierungskapazitäten müssen dafür aufgebaut werden, und wie stabil bleiben die Lernkurven bei den Herstellprozessen? Genau dort entscheidet sich, ob der Investitionszyklus zur reinen Vorleistung wird oder ob die Kundenanforderungen in planbare Produktionsergebnisse münden.
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