TAIPEH / LONDON (IT BOLTWISE) – Silicon Motion hat die Basisarchitektur für seine PCIe-7.0-Controllerfinalisiert und peilt ab 2027 stark steigende Bandbreiten für KI-Workloads an. Der Hersteller nennt Zielwerte bis zu 128 GB/s pro Lane und in x16-Konfigurationen Geschwindigkeiten von bis zu 512 GB/s. Für den Betrieb in hochskalieren KI-Umgebungen sollen zudem bis zu 50 Millionen IOPS möglich sein. Bis zur Marktreife überbrückt das Unternehmen mit PCIe-6.0-Controllern, die bereits auf FPGA-Plattformen getestet wurden.
Silicon Motion stellt die Weichen für die nächste Generation von KI-fähiger Speicheranbindung: Der taiwanische Chipentwickler hat das Design seiner PCIe-7.0-Controller-Architektur abgeschlossen und damit den Weg für einen Markthorizont ab 2027 geöffnet. Hintergrund ist nicht nur ein neuer Standard, sondern der Engpass, den viele Rechenzentren derzeit spüren, sobald Modelle wachsen und Datenströme in Echtzeit verarbeitet werden müssen. Wer KI-Workloads betreibt, braucht nicht nur schnelle SSDs, sondern auch eine Paketierung und Steuerung, die hohe Parallelität ausnutzt. Genau dort setzt der Controller an.
Technisch betrachtet entscheidet bei PCIe weniger die „Peak“-Zahl als die Kombination aus Lane-Skalierung, Latenzverhalten und der Fähigkeit, I/O-Lasten effizient zu verwalten. Silicon Motion nennt für PCIe 7.0 rund 128 GB/s pro Lane als Zielgröße. In einer x4-Konfiguration entspräche das etwa 64 GB/s, während x16 theoretisch bis zu 512 GB/s ermöglicht. Ergänzend wird eine Zielmarke von bis zu 50 Millionen IOPS genannt. Solche Werte sind vor allem für Szenarien relevant, in denen viele Streams gleichzeitig auf speichernahe Beschleuniger zugreifen, statt sequentiell zu lesen.
Historisch zeigt sich: Neue PCIe-Generationen werden häufig zuerst auf Plattformebene erprobt, bevor echte Produkte in Massenvolumen gehen. Nach der Verabschiedung des PCIe-7.0-Standards am 11. Juni 2025 ist Silicon Motion in die Definitionsphase seiner siebten Controller-Generation eingestiegen. Erste technische Muster der neuen Chips sollen demnach in der zweiten Jahreshälfte 2027 vorliegen. Bis dahin will das Unternehmen mit PCIe-6.0-Controllern überbrücken, die bereits auf FPGA-Plattformen getestet wurden. Dieses Vorgehen ist typisch: FPGA-Prototypen helfen, Interoperabilität und Timing-Probleme früher zu erkennen.
Marktseitig ist die Fokussierung auf KI-Storage ein klarer Hebel. Laut den mitgelieferten Zahlen stieg der Aktienkurs von Silicon Motion innerhalb von drei Monaten um 89 Prozent. Gleichzeitig erreichte der Umsatz im ersten Quartal 2026 342,11 Millionen Euro – ein Plus von 105,5 Prozent gegenüber dem Vorjahreszeitraum. Der Gewinn pro Aktie lag mit 1,58 Euro über den Analystenerwartungen. Untermauert wird der strategische Kurs durch den Hinweis, dass die Hauptzielgruppe hochskalierte KI-Umgebungen sind, insbesondere im Umfeld von NVIDIA-Storage-Next-Architekturen.
Während Silicon Motion an PCIe 7.0 arbeitet, beschleunigen Wettbewerber die Umsetzung aktueller Standards – und das verändert die Beschaffungsspirale. Kioxia bringt etwa die XG10-Serie mit PCIe 5.0 auf den Markt; erste Muster sollen an PC-Hersteller gehen, die Auslieferung startet im zweiten Quartal 2026. Longsys produziert monatlich über eine Million Gen5-mSSDs mit Geschwindigkeiten jenseits von 12 GB/s, getrieben vom KI-PC-Markt. Samsung positioniert sich zusätzlich über PCIe-4.0-Straßen mit der 990-SSD (Ende Juli 2026 in Indien). Daneben wird im CXL-Speichersegment ein Rennen zwischen Samsung und SK Hynix um CXL 3.2 genannt.
Für Unternehmen stellt sich daraus vor allem die Frage nach der Systemplanung: Welche Kombination aus PCIe-Generation, Controller-Fähigkeiten und Speicherprotokollen erfüllt die erwartete Nutzlast, ohne die Lieferkette zu riskieren? Marktforscher warnen in diesem Zusammenhang vor Engpässen beim Bau neuer Rechenzentren; Moratorien und Kapazitätsgrenzen in Regionen wie Amsterdam und New York sollen die Expansion bremsen. Gleichzeitig bleibt der KI-Hunger nach Speicher ungebrochen, etwa mit der Prognose, dass Server-DRAM und High-Bandwidth Memory (HBM) bis 2026 rund 57 Prozent des Marktes ausmachen. Wer hier zu spät skaliert, zahlt in der Praxis oft mit teuren Umrüstungen.
Auch die regulatorische Dimension rückt in den Vordergrund, weil sich Speicher- und KI-Stacks zunehmend überschneiden. Mit der neuen EU-KI-Verordnung steigen für viele Organisationen Anforderungen an Dokumentation, Risikoklassen und Qualitätssicherung. Das betrifft nicht nur Trainings- und Inferenzmodelle, sondern indirekt auch die Betriebsumgebung, in der Daten verarbeitet und I/O-Entscheidungen automatisiert werden. Für CIOs und CISO-Teams bedeutet das: Controller- und Storage-Updates sollten künftig stärker mit Governance-Prozessen gekoppelt werden, inklusive Nachweisführung für Betrieb, Logging und Zugriffskontrollen. Gerade in Hochleistungsumgebungen darf Security nicht zur Latenzquelle werden.
Der weitere Ausblick hängt deshalb an zwei Achsen: Skalierung der Hardware und Absicherung des Betriebs. Kurzfristig müssen Rechenzentren ihre Roadmaps zwischen PCIe 6.0-Übergang und PCIe 7.0-Sprung so takten, dass Investitionszyklen nicht kollidieren. Mittel- bis langfristig dürfte die Branche von Controllern erwarten, dass sie nicht nur Bandbreite liefern, sondern auch die I/O-Planung stabil halten, wenn Workloads von Training zu Inferenz wechseln. Als Implikation für Entwickler und Betreiber gilt: Wer KI-Workloads orchestriert, sollte Storage-Profile und Telemetrie frühzeitig mit den zu erwartenden Controller-Generationen abstimmen. So lässt sich später vermeiden, dass Leistungsgewinne durch mangelnde Lastverteilung oder unzureichende Policy-Durchsetzung verpuffen.
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