SANTA CLARA / LONDON (IT BOLTWISE) – AMD stellt mit der EPYC-9006-Serie „Venice“ eine neue Server-Generation vor, die konsequent auf KI und Hochleistungsrechnen zielt. Die Plattform setzt auf bis zu 256 Kerne, 512 Threads sowie ein 2-Nanometer-Fertigungsverfahren bei TSMC. Dazu kommen speicher- und interconnect-seitig deutliche Upgrades, etwa DDR5-8000, MRDIMM, PCIe Gen6 und CXL 3.1. Entscheidend wird, wie sich das Leistungsversprechen von bis zu 3,4-facher Geschwindigkeit in realen Training- und Inferenzlasten bewährt.
AMD hat auf seiner Hausmesse „Advancing AI 2026“ eine neue EPYC-Servergeneration in den Mittelpunkt gerückt, die das Unternehmen nicht nur als CPU-Refresh versteht, sondern als direkten Angriff auf die KI-Cluster-Architektur. Im Zentrum steht die EPYC-9006-Serie mit dem Codename „Venice“. Besonders auffällig: AMD positioniert die Chips ausdrücklich für Workloads, die sowohl große Modelltrainings als auch ausgelagerte HPC-Aufgaben umfassen, also genau die Lastprofile, bei denen Speicherbandbreite, Interconnect-Latenz und die Fähigkeit zur skalierbaren Parallelverarbeitung mit über den Gesamtdurchsatz entscheiden.
Technisch beginnt der Schritt bei der Fertigung. „Venice“ wird im 2-Nanometer-Verfahren von TSMC hergestellt und erreicht bis zu 256 Kerne sowie 512 Threads. AMD beschreibt dafür eine modulare Multi-Die-Strategie: Acht Core-Complex-Dies mit jeweils 32 Kernen arbeiten zusammen, ergänzt um zwei große I/O-Dies. Diese Aufteilung ist für Server-Designs relevant, weil sie die Trennung von rechenintensiven Pfaden und I/O-seitigen Engstellen unterstützt. Gerade im KI-Stack, in dem CPUs häufig als Taktgeber für Data-Pipelines, Netzwerkstacks und Speichertransfers fungieren, kann eine sauber dimensionierte I/O-Architektur darüber entscheiden, ob GPUs oder die Plattform selbst zum Flaschenhals werden.
Beim Speicher und bei den Schnittstellen nennt AMD mehrere Bausteine, die auf hohe Bandbreite und moderne Kohärenz zielen. Die „Venice“-Chips unterstützen 16-Kanal-DDR5-8000 oder den neuen MRDIMM-Standard mit bis zu 1,6 Terabyte pro Sekunde Bandbreite. Ergänzend nennt AMD PCIe Gen6 sowie CXL 3.1 als Teil der Plattform. Für Unternehmen, die KI-Cluster planen, ist diese Kombination mehr als ein Datenblatt-Vorteil: CXL 3.1 adressiert genau die Anforderungen, Memory-Expansion, Geräte-Cohärenz und dynamischere Systemtopologien zu unterstützen. Das passt zu Architekturen, in denen KI-Inferenz oder Training dynamische Speicherumgebungen brauchen, etwa bei häufig wechselnden Sequenzlängen, Modellvarianten oder der Zuweisung von Ressourcen über mehrere Nodes hinweg.
AMD bezieht die Messlatte sehr hoch und nennt interne Benchmarks als Referenz. Der Spitzenprozessor EPYC 9996 soll in diesen Tests aktuelle Intel-Xeon-Varianten um das bis zu 3,4-Fache übertreffen. Gleichzeitig positioniert AMD einen Vorsprung von bis zu 20 Prozent gegenüber Nvidias Vera-Systemen. Solche Vergleiche sind im Enterprise-Kontext allerdings nur der Startpunkt: Entscheidend ist, ob sich die relative Steigerung in den konkreten Workloads reproduzieren lässt, in denen etwa CPU-seitige Vorverarbeitung, Datenkompression oder Netzwerkverarbeitung den effektiven End-to-End-Durchsatz prägen. Auch die thermische Verlustleistung von bis zu 600 Watt ist ein Hinweis darauf, dass AMD hier massiv Rechenleistung in den Serveralltag übersetzt und damit für Betreiber Fragen zu Kühlung, Power-Management und Rack-Level-Thermal-Design besonders sorgfältig beantworten muss.
Parallel zur „Venice“-Generation richtet AMD den Blick nach vorn und beschreibt Spezialvarianten für 2027. „Venice-X“ wird mit 3D-V-Cache-Technologie angekündigt und soll 1152 Megabyte L3-Cache bieten, dazu bis zu 5,15 Gigahertz Takt. AMD spricht diese Variante gezielt für rechenintensive HPC-Workloads an, bei denen größere Caches und schnellere Datenzugriffe wiederkehrende Muster in Simulationen, Finite-Elemente-Berechnungen oder bestimmten KI-nahen numerischen Anwendungen beschleunigen können. Ebenfalls für 2027 angekündigt ist die EPYC-Verano-Serie, optimiert für „Agentic AI“ sowie hochfrequente Aufgaben. Die „Verano-LP“-Variante soll energieeffizienten LPDDR5X-Speicher nutzen, was vor allem für Szenarien interessant ist, in denen eine hohe Anzahl schneller Iterationen auf Kosten minimaler Energie pro Operation skaliert.
Den KI-Fokus komplettiert AMD mit der Helios-Rack-Plattform für große Modellgrößen. Ein Rack soll 72 Instinct-MI455X-GPUs enthalten und dabei 2,9 Exaflops FP4-Leistung liefern; AMD beziffert das als 2,9 Trillionen Rechenoperationen pro Sekunde. Auf GPU-Seite nennt AMD 432 Gigabyte HBM4-Speicher pro Rack-Einheit mit 23,3 Terabyte pro Sekunde Bandbreite. Für Betreiber heißt das: Wer solche Systeme in die Produktion bringt, muss nicht nur die GPU-Performance betrachten, sondern das gesamte Zusammenspiel aus Speicherhierarchie, CPU- und Netzwerkpfaden, Stromversorgung sowie dem Scheduling in der Orchestrierung. Die ersten Helios-Racks sollen bereits in Produktion sein, erste Auslieferungen plant AMD für das dritte Quartal 2026, den Massenhochlauf in der zweiten Jahreshälfte 2027; ein voll bestücktes Rack beziffert AMD mit rund 5,25 Millionen Euro. Solche Zahlen machen deutlich, dass AMD hier den Weg in Richtung „Cluster-as-a-Service“-Denke beschleunigt: Der Bedarf verschiebt sich von einzelnen Beschleunigern hin zu komplett verplanter Infrastruktur.
Dass die Nachfrage in diese Richtung geht, unterstreichen die von AMD genannten Buchungen: Anthropic habe 2 Gigawatt Helios-Kapazität gebucht, OpenAI und Meta jeweils 6 Gigawatt; OpenAI will noch 2026 mit dem Deployment beginnen. Zusätzlich kündigt AMD an, dass Microsoft Azure Pläne für den Einsatz vorbereitet. Abseits der reinen Hardware spielt auch ein anderes Thema in der Nachricht hinein: Wenn KI-Systeme schneller in Produktion gehen, steigen die regulatorischen und Governance-Anforderungen an Nachvollziehbarkeit, Risikoanalyse und Dokumentationsqualität. In demselben Kontext verweist AMD zudem auf die EU AI Act-Umsetzung, was zeigt, dass sich Anbieter und Betreiber zunehmend nicht mehr nur über Benchmarks, sondern über Betriebsfähigkeit und Compliance bis in die Prozesse hinein abstimmen müssen.
Auch das „Edge“- und Robotik-Segment bekommt bei AMD Aufmerksamkeit. Mit der Ryzen AI Embedded X100-Serie wagt das Unternehmen den Vorstoß in die Robotik und kombiniert bis zu 16 Zen-5-Kerne, RDNA-3.5-Grafik mit 40 Compute Units sowie eine XDNA-2-NPU für KI-Aufgaben. Die Embedded-Prozessoren sollen für industrielle Dauerlasten ausgelegt sein, mit einem Temperaturfenster von minus 40 bis plus 105 Grad Celsius und einer Lebensdauer von zehn Jahren Dauerbetrieb. Zusätzlich plant AMD eine Robotics Developer Platform ab dem vierten Quartal 2026; das Robotics Partner Network soll bereits über 30 Partner umfassen, die die Plattform lizenzkostenfrei nutzen. Ab August 2026 soll außerdem das ROCm.ai-Softwarepaket erweitert werden, um die KI-Entwicklung auf neuen Plattformen zu beschleunigen. Zusammen ergibt das ein Bild: AMD will aus der Rolle des Herausforderers heraus mehr Systemsicht liefern – von der Server-CPU über das Rack bis in die Plattform für Entwickler – und damit die Voraussetzungen schaffen, dass KI-Workloads nicht nur auf dem Papier schnell sind, sondern sich in der Praxis skalieren und betreiben lassen.
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