LONDON (IT BOLTWISE) – Alphabet hebt sein KI-Infrastruktur-Budget für 2026 erneut an und plant laut den Q2-Zahlen Investitionen zwischen 195 und 205 Milliarden US-Dollar. Damit verschiebt sich der Fokus weiter von Modellen hin zu Rechenzentrums- und Chip-Ökosystemen. Für Unternehmen, die TPUs, Optical Switching, Hochgeschwindigkeits-Laser-Chips oder HBM-Lieferketten liefern, entsteht dadurch zusätzliche Nachfrage über mehrere Quartale hinweg. Entscheidend wird dabei, wie schnell sich die Ausbaukapazitäten entlang der gesamten Lieferkette skalieren lassen.
Alphabet erhöht seine Ausgaben für die KI-Infrastruktur erneut – und zwar so deutlich, dass sich die Wirkung über das eigene Rechenzentrum hinaus in die Zuliefererlandschaft übersetzt. In den Q2-Ergebnissen nennt das Unternehmen für 2026 ein Capex-Budget von 195 bis 205 Milliarden US-Dollar. Zuvor war von 180 bis 190 Milliarden US-Dollar die Rede. Zusätzlich deutet Alphabet an, dass es auch im Folgejahr nochmals stärker investieren will. Für die Marktlogik ist das mehr als eine Zahlenspielerei: Der Ausbau betrifft nicht nur die Serverzahl, sondern auch die benötigten Komponentenketten rund um TPUs, Netzwerktechnik und die darauf abgestimmte Speicherhierarchie.
Technisch betrachtet beginnt die nächste Ausbaustufe bei den Rechenchips. Ein Baustein sind die TPU-basierten Systeme, für die Alphabet spezialisierte Hardware einsetzt. Broadcom wird in diesem Zusammenhang als Mitentwickler der Tensor Processing Units genannt: Broadcom liefert dabei die physische Gestaltung und übernimmt laut Angaben auch die Supply-Chain für diese benutzerdefinierten AI-ASICs. Genau an dieser Stelle wird Capex zu Umsatzlogik, weil die Auslieferung der Chips und die zugehörigen Komponenten ein konkreter Werttreiber für den Halbleiter-Zulieferer sind. Darüber hinaus verfügt Broadcom über ein großes Networking-Geschäft, das parallel zu den KI-Datenzentrumskosten profitieren kann, weil eine wachsende TPU-Flotte auch mehr Netzwerkkapazität und Routing-Fähigkeiten benötigt.
Damit die TPUs im Maßstab funktionieren, muss die Hardware-Integration in die reale Betriebswelt überführt werden. Celestica wird dabei als zentraler Hardware-Integrationspartner beschrieben: Das Unternehmen stellt benutzerdefinierte gedruckte Leiterplatten (PCBs) her, baut die physischen Servergehäuse und kümmert sich um das Zusammenspiel der Server-Trays zu Racks. In der Architektur spielt zusätzlich die Verbindungs- und Schalttechnik eine Rolle, denn Celestica liefert Netzwerk-Switches, die den Verkehr zwischen TPU-Pods handhaben sollen. Aus Marktsicht ist auch die Kundenkonzentration relevant: Die drei größten Hyperscaler-Kunden zusammen machen mehr als 50% des Umsatzes aus, wobei Alphabet als größter Kunde mit rund 28% der Einnahmen im ersten Quartal eingeordnet wird. Bei einem Capex-Anstieg um insgesamt 15 Milliarden US-Dollar nach oben gegenüber der vorherigen Spanne wird damit nicht nur rechnerische Leistung, sondern auch Integrationskapazität auf der Ebene der Fertigung und Systemmontage auf die Probe gestellt.
Ein weiterer Flaschenhals liegt in der Datenübertragung innerhalb der KI-Cluster. In dem beschriebenen TPU-Ansatz nutzt Alphabet direkte optische Circuit Switches (OCS): Daten bleiben demnach als Lichtsignale erhalten, statt zu elektrischen Signalen umgewandelt zu werden, um sie weiterzuleiten. Das soll sowohl den Energieverbrauch als auch die Latenz senken. Lumentum wird hier als Zulieferer eingeordnet, weil das Unternehmen zu den wenigen globalen Lieferanten zählt, die hochgeschwindigkeitsfähige 200G-Laser-Chips (EMLs) in Serie produzieren können. Wenn OCS und damit die optische Signalstrecke skaliert werden, steigt die Nachfrage nach genau solchen Komponenten, die die Lichtsignale auf dem erforderlichen Durchsatz erzeugen.
Neben den kundenspezifischen TPUs kauft Alphabet jedoch auch GPUs von NVIDIA. Das ist für die Investitionsstory wichtig, weil es die Capex-Wirkung breiter verteilt: TPUs seien für Pre-Training und Inferenz besonders stark, während GPUs bei Forschung, bei Custom-Kernels, bei sparsamen Modellen und bei vielen kleineren Modellen oft besser passen. Damit erhält NVIDIA ebenfalls einen Anteil an dem größeren Investitionskuchen. Gleichzeitig kann ein beschleunigter Ausbau der KI-Infrastruktur bei Alphabet eine Zweite-Runde-Effekt-Logik auslösen: Hyperscaler könnten in Reaktion auf ähnliche Engpässe oder Ausbaugeschwindigkeiten eigene Budgets erhöhen. Für Unternehmen ist in diesem Setup allerdings nicht nur die Chip-Wahl entscheidend, sondern auch die Peripherie, insbesondere bei Speichersystemen.
Genau dort wird der Einfluss sehr konkret über High-Bandwidth Memory (HBM) sichtbar. Mit mehr TPUs und GPUs steigt der Bedarf an HBM, das als spezieller DRAM in die Chip-Pakete integriert wird, um deren Performance zu optimieren. Samsung wird als primärer HBM-Lieferant für Alphabet beschrieben und arbeitet dabei direkt mit Broadcom zusammen; laut den Angaben liefert Samsung mehr als 60% von Alphabets HBM-Anforderungen für TPUs. Der Rest soll vor allem über SK Hynix kommen, das außerdem als Hauptlieferant für HBM bei NVIDIA-GPUs genannt wird. Micron spielt in diesem Szenario zwar bei Alphabet nicht die größte Rolle bei der HBM-Versorgung, wird aber als potenzieller Anbieter weiterer Lösungen eingeordnet, etwa hochdichtes Enterprise-Speicher-Storage in Form von eSSDs für Google Cloud sowie DDR5-Server-DRAM. Weil HBM-Nachfrage meist in einer größeren Speicher- und Preislogik mündet, kann zusätzlicher Bedarf auch die allgemeinen DRAM-Preise stützen – mit Auswirkungen auf Umsatz und Bruttomargen bei den großen DRAM-Anbietern.
Schließlich hängt der Ausbaufortschritt stark von der Herstellung und dem Packaging der fortgeschrittenen Chips ab. Taiwan Semiconductor Manufacturing profitiert laut Darstellung typischerweise von jedem Anstieg bei Investitionen in Advanced Logic, weil das Unternehmen eine nahezu monopolartige Position bei der Fertigung solcher Logikchips einnimmt. Selbst wenn Alphabet berichtet wird, eine TPU-Bestellung mit Intel zu platzieren, entfallen in der Praxis weiterhin die meisten TPUs auf den genannten Fertigungsweg. Zusätzlich liefert TSMC die Packaging-Schritte, die HBM mit dem TPU-Die verbinden, etwa im beschriebenen CoWoS-Ansatz (chip-on-wafer-on-substrate). In Summe sorgt genau diese Kopplung dafür, dass Capex nicht nur an der Software- oder Modellschicht „hängt“, sondern unmittelbar die Auslastung in der Halbleiterfertigung und im fortgeschrittenen Packaging beeinflusst.
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