LONDON (IT BOLTWISE) – Speicherzentrierte Chip-Entwürfe können bei künftigen Weltraumteleskopen den entscheidenden Engpass entschärfen: die Datenbewegung statt die Rechenleistung. Ein SRAM-Design soll in Simulationen bis zu 59-mal weniger Leistung als eine GPU-Alternative benötigen. Die Autoren rechnen dadurch nicht nur mit deutlich weniger Energiebedarf, sondern auch mit einer drastisch geringeren Satellitenmasse. Für die nächsten Schritte steht an, die SRAM-Chiplets im Labor zu fertigen und unter realistischen Bedingungen zu testen.

Künftige Weltraumteleskope stehen vor einem technischen Zielkonflikt: Sie müssen extrem präzise arbeiten, während sie gleichzeitig mit sehr begrenzter Energie an Bord auskommen. Wenn ein Teleskop in Echtzeit winzige optische Verzerrungen ausgleichen muss, um das grelle Licht entfernter Sterne zu blockieren, entsteht eine Rechenkette, bei der das Verschieben von Daten häufig den eigentlichen Flaschenhals bildet. Genau hier setzen die Arbeiten eines Teams von der University of Michigan an. In einem als Studie beschriebenen Ansatz wird nicht primär nach “mehr Rechenleistung” gesucht, sondern nach einer Architektur, die denselben Aufwand bei speicher- und datenintensiven Workloads effizienter bewältigt.
Im Zentrum stehen zwei speziell entworfene hardware-nahe Varianten, beide als “memory-centric accelerators” gedacht. Die erste nutzt ein HBM-Konzept (High Bandwidth Memory), bei dem 27 HBM-Chips in einer horizontalen Anordnung platziert werden. Jeder dieser HBM-Chips besteht aus einem Stapel aus 16 DRAM-Chips; diese breite Speicheranbindung soll dafür sorgen, dass Daten schneller “am richtigen Ort” ankommen, statt ständig über lange interne Wege bewegt werden zu müssen. Die zweite Variante verfolgt ein stärker verteiltes Modell: Sie teilt Daten und Verarbeitung auf 56 benutzerdefinierte Chiplets auf, wobei jedes Chiplet etwa 2 GB verteilten SRAM enthält. Die Grundidee dahinter ist anschaulich: Statt die Boxen für jede einzelne Rechenaktion hin und her zu transportieren, wird die “Arbeitsstelle” näher an den Speicher gebracht.
Entscheidend wird diese Architektur aber erst, wenn man die Art der Zielrechnung berücksichtigt. Für das Abbilden von Exoplaneten, insbesondere bei der Suche nach erdähnlichen Welten, sind dichte Matrixoperationen sowie eine geringe “Arithmetic Intensity” typisch, also relativ viele Speicherzugriffe im Verhältnis zu dem, was in jeder Rechenrunde tatsächlich neu berechnet wird. Die Autoren vergleichen den Engpass mit einem Organisationsproblem: Man müsse erst weit fahren, eine einzelne Box abholen, zurückgehen, die Box öffnen und erst danach wieder zur nächsten Box losfahren. In der Chipwelt übersetzt sich das in häufige Datenzugriffe und Transfers. Für beide Entwürfe wird zudem die Robustheit gegenüber Strahlungsfehlern berücksichtigt, ein klassisches Thema bei Raumfahrt-Elektronik. Dazu führen die Forschenden nach Angaben der Beschreibung 10.000 Simulationen durch, in denen Fehler injiziert werden, die kosmische Strahlung verursachen könnte, etwa indem während einer Berechnung Bits von 0 auf 1 “kippen”. Die mathematische Schutztechnik ABFT (Algorithm-Based Fault Tolerance) soll gefährliche Fehler detektieren, dabei aber so arbeiten, dass keine falschen Alarme auftreten, die das Bild unbrauchbar machen würden.
Die Leistungs- und Skalierungszahlen zeigen, warum SRAM in der Diskussion besonders hervorsticht. Für die Simulationen nutzen die Autoren eine Toolchain auf Basis von Synopsys Design Compiler, um Stromverbrauch, Geschwindigkeit und Flächengrößen der Entwürfe zu schätzen. Für die Einordnung in einen realistischen Missionskontext ziehen sie etablierte Formeln aus der Luft- und Raumfahrt heran. Als Vergleichsbasis dient ein “standard GPU setup”, das demnach etwa 3.000 W Leistung beanspruchen würde. Der HBM-Ansatz mit den 27 Stapeln senkt diese Last laut den Angaben auf 928 W. Die SRAM-Variante mit 56 Chiplets reduziert den Bedarf weiter auf 90 W. Noch stärker wirkt eine zusätzliche mathematische Vereinfachung: Durch eine Rundung, die dem Äquivalent von sieben Dezimalstellen entspricht, benötigt das SRAM-Design laut Simulation nur 51 W. Das wird als 59-fache Reduktion gegenüber der GPU-Baseline beschrieben.
Der Effekt ist nicht nur eine Zahl im Datenblatt, sondern verändert die Systemarchitektur eines Satelliten. In der Raumfahrt ist jedes zusätzliche Watt eng gekoppelt an Folgekomponenten: größere Solarflächen für die Stromversorgung, größere Batteriesysteme für die Energiespeicherung sowie leistungsfähigere Kühleinheiten, damit die Elektronik nicht thermisch aus dem Toleranzbereich läuft. Die Autoren leiten daraus eine direkte Masseabschätzung ab: Wenn der Rechenbedarf von 3.000 W auf 51 W sinkt, soll sich die Satellitenmasse von 1.100 kg auf 193 kg reduzieren lassen. Über eine 25-jährige Missionsdauer wird diese Gewichts- und Leistungsverschiebung in der Beschreibung als Einsparung von 430 Mio. US-Dollar beziffert. Selbst wenn einzelne Annahmen je nach Missionsdesign variieren können, illustriert die Größenordnung, dass Architekturentscheidungen im Rechenzentrum-orientierten Sinne im Weltraum schnell zu Systementscheidungen werden.
Im technischen Kontext ist außerdem wichtig, wo die Entwürfe ihre “Arbeitsumgebung” haben: Das Team bewertet die Designs im Zusammenhang mit der Habitable Worlds Observatory, einer von NASA beschriebenen zukünftigen Mission, die am Sun-Earth L2-Punkt betrieben werden soll. L2 ist auch der Orbit-Bereich des James Webb Space Telescope; dort profitieren Teleskope von einem dauerhaft ähnlichen Ausrichtungsgeometrieproblem, bei der Sonne, Erde und Mond in einer Weise hinter der Raumsonde “zusammen” ausgerichtet bleiben. Für die Bildgebung erfordert das Zusammenspiel aus Abschirmung und Echtzeit-Korrektur präzise Berechnung, und genau deshalb sind zeitkritische Datenflüsse in den Fokus gerückt. Der Ansatz der Speicherzentrierung passt daher auch strategisch: Er versucht, die Rechenmaschine so zu bauen, dass sie zu den Workloads passt, statt die Workloads auf eine Rechenplattform zu “ziehen”.
Für die Industrie und für Entwickler in der Raumfahrt-Computing-Ecke ist das vor allem eine Einladung, Speicherhierarchien und Datenpfade als erste Klasse der Architektur zu behandeln. Viele Diskussionen in der KI- und Beschleunigerwelt drehen sich um Rechenkerne, Tensor-Engines oder GPU-ähnliche Designs; im Weltraum verschiebt sich der Schwerpunkt jedoch schnell auf Leistungsbudget, Strahlungsrobustheit und die Effizienz der Datenbewegung über alle Ebenen hinweg. Als nächsten Schritt kündigen die Autoren an, die SRAM-Chiplets zu fertigen und im Labor zu testen. Damit verlagert sich die Bewertung von der Simulation in die praktische Welt: Die entscheidenden Fragen lauten dann, ob sich die versprochenen Energiegewinne unter realen Takt- und Speicherzugriffsbedingungen reproduzieren lassen und wie gut ABFT und Fehlertoleranzkonzepte in der konkreten Implementierung funktionieren.
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