LONDON (IT BOLTWISE) – NVIDIA und Cisco treiben mit Ultra-Dense Small Form Factor Pluggable (USFP) eine neue Optik-Bauform voran, die 400Gb/s pro Lane in modulare Transceiver bringt. Die Spezifikation soll es ermöglichen, Ethernet-basierte KI-Fabrics ohne zusätzliche Netzwerk-Tiers weiter hochzuskalieren. Dafür setzen die Partner auf höhere Bandbreitedichte bei gleichzeitig bis zu 100 Watt Verlustleistung sowie eine Connector-Mechanik mit zwei-stufigem Einrasten. Für Betreiber bedeutet das vor allem: mehr Rechenleistung ans Netz koppeln, während der Energieanteil des Netzwerks pro übertragenem Bit sinken soll.
Wenn KI-Modelle größer werden und vor allem die Inferenz in der Breite anzieht, verschiebt sich der Engpass in vielen Rechenzentren immer stärker vom reinen Rechenkern hin zur Verbindungstechnik. Genau dort setzen NVIDIA und Cisco mit Ultra-Dense Small Form Factor Pluggable (USFP) an: einer modularen Optik-Bauform, die 400Gb/s-pro-Lane elektrische Signale adressieren soll. Die Kernidee ist nicht nur mehr Geschwindigkeit, sondern ein Skalierungsweg, der die Netzwerkkomplexität im gleichen physischen Footprint begrenzt. Denn sobald Schalter an Kapazitätsgrenzen stoßen, führt weiterer Ausbau in der Praxis häufig zu zusätzlichen Switch-Layern und zu mehr optischen Links – mit typischen Folgen wie höherer Latenz, steigender Leistungsaufnahme und wachsenden Gesamtkosten.
USFP ist als Erweiterung des bisher etablierten pluggable-Transceiver-Ansatzes gedacht: Es soll von 200Gb/s pro Lane hin zu 400Gb/s pro Lane auf Ethernet-„AI-Fabrics“ skalieren können, ohne dass Betreiber ihre Datenzentrumsarchitektur komplett neu aufrollen müssen. In der Ankündigung werden dafür konkrete Zielwerte genannt: USFP soll eine Kapazität von bis zu 12,8Tb/s ermöglichen und dabei 4x mehr Bandbreitedichte liefern als 200Gb/s-pro-Lane-Pluggables. Zusätzlich nennen die Partner eine etwa 1,3-fache Leistungseffizienz im Sinne von „pro übertragenem Bit“ weniger Strombedarf. Das adressiert ein ganz praktisches Rechenzentrumsproblem: Netzwerke verbrauchen nicht nur Strom, sie bestimmen auch, wie effizient Switch-ASICs mit den angebundenen GPUs und SuperNICs ausgelastet werden können.
Technisch betrachtet ist die mechanische und elektrische Anbindung ein zentraler Hebel. USFP setzt auf eine neue zweidimensionale Array-Connector-Struktur mit einem zweistufigen Einsteckdesign: Die hochgeschwindigkeitsrelevanten Kontakte sollen erst nach dem Einsetzen des Moduls „engagieren“. Solche Sequenzierung kann die Belastung der Kontaktflächen reduzieren, die Signalqualität stabilisieren und die Einsteckkräfte planbarer machen. Gleichzeitig bleibt der Ansatz skalierbar: Der Connector ist darauf ausgelegt, die Anzahl der Full-Duplex-Lanes perspektivisch auf 32 und mehr zu erhöhen. Interessant ist dabei auch der Rückwärtsgedanke im Text: Weil der Connector für 400Gb/s ausgelegt ist, soll er bei 200Gb/s pro Lane ebenfalls verbesserte Performance bieten.
Auch die thermische und systemseitige Integration soll den Ausbau erleichtern. USFP unterstützt eine Power Dissipation von bis zu 100 Watt, ohne dass im Transceiver ein separater, dedizierter Embedded-Cooling-Zirktuit nötig sein soll. Für Switch-Designs und Backplanes kann das einen deutlichen Vereinfachungseffekt haben, weil weniger Spezialkomponenten in der Peripherie entstehen und die Zuverlässigkeit des Gesamtsystems steigt. Ergänzend erwähnen die Partner, dass alle USFP-Konfigurationen auf optischen Designs setzen sollen, die Latenz und Leistungsaufnahme reduzieren, indem Signalverarbeitung vereinfacht wird. Dazu kommt eine Unterstützung für unterschiedliche optische Technologien und Verbindungsdistanzen, damit Systemdesigner die Verbindung an die konkrete Deployment-Realität einer KI-Factory anpassen können.
Für den Markt ist mindestens ebenso wichtig, dass USFP nicht als Single-Vendor-Lösung positioniert wird, sondern als Hardware-Ökosystem. NVIDIA und Cisco arbeiten demnach mit TE Connectivity und Amphenol an USFP Cages, Connectors und Modulen; weitere Partner sollen später hinzukommen. Das Ziel ist eine gemeinsame Formfaktor-Basis für hochdichte pluggable Infrastruktur mit 400Gb/s-pro-Lane-Fabrics – damit nicht jeder Hersteller seine eigene mechanische und elektrische „Insel“ baut. Darüber hinaus soll die Zusammenarbeit die Interoperabilität zwischen NVIDIA Spectrum-X Ethernet-Netzwerken und Cisco-„Silicon One“-basierten Ethernet-Netzen vereinfachen, sodass sich KI-Infrastruktur für Enterprise-Umgebungen ebenso wie für neoclouds und sovereign clouds schneller implementieren lassen soll. Operativ kündigen die Partner außerdem an, eine offene Industriespezifikation für USFP über ein Community-getriebenes Multi-Source-Projekt zu schaffen – ein Schritt, der die Austauschbarkeit und damit die Skalierbarkeit im Beschaffungsprozess stärken kann.
Was das für Betreiber und Entwicklerteams konkret bedeuten kann, lässt sich an der beschriebenen Skalierungslogik festmachen: Wenn sich mehr Bandbreite in denselben Netzwerk-Rahmen pressen lässt, sinkt der Druck, zusätzliche Switch-Tiers einzubauen, um weiterhin genügend Endpunkte anzubinden. In der Ankündigung werden dabei „erste geplante USFP-basierte Transceiver“ mit 16 Full-Duplex-Lanes in einem OSFP-ähnlichen Octal-Small-Form-Factor genannt, mit der Perspektive auf 32 Lanes. Zudem wird der Umstand hervorgehoben, dass sich damit mehr Endpunkte von bis zu 1,6Tb/s pro Fabric anschließen lassen sollen, während insgesamt 12,8Tb/s Kapazität erreichbar sein sollen. Für KI-Fabrics heißt das vor allem: mehr System-Scale über die Interconnect-Ebene, bei gleichzeitig reduzierter Stromrechnung pro Bit – genau die Kombination, die in Rechenzentren den Unterschied macht, wenn Budgets und Wärmelimits stärker werden.
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