LONDON (IT BOLTWISE) – TSMC meldet einen früheren als erwarteten Rollout seines 2-Nanometer-Prozesses. Der Fertigungsknoten trägt aktuell rund 3 Prozent zum Wafer-Umsatz bei, während Fab 20 in Taiwan bereits auf 20.000 Wafer pro Monat hochfährt. Parallel baut der Konzern die Verpackungskapazitäten aus und verhandelt für 2027 Preisanpassungen von 5 bis 10 Prozent. Am Markt steht die Aktie trotz des technologischen Fortschritts zuletzt unter Druck.
Die Nachricht, dass TSMC den Umsatzbeitrag der 2-Nanometer-Fertigung „deutlich früher als erwartet“ sieht, ist vor allem deshalb wichtig, weil die kritische Lücke zwischen Technik-Demo und betrieblichem Volumen oft die teuerste Phase ist. Wenn ein neuer Chipknoten nicht nur im Labor funktioniert, sondern bereits messbar in die Wafer-Absätze hineinwirkt, verschiebt das die Planbarkeit für Entwickler, die ihre Tape-outs im Voraus timen. Laut den Angaben des Unternehmens trägt der 2-Nanometer-Prozess aktuell rund 3 Prozent zum Wafer-Umsatz bei. Diese Größenordnung klingt zunächst nach einer Momentaufnahme, hat aber eine klare Signalwirkung: Der Hochlauf ist schneller als in Teilen der Branche erwartet, und damit steigt die Wahrscheinlichkeit, dass nachfolgende Quartale nicht nur Kapazität aufbauen, sondern auch echte Produktnachfrage abbilden.
Im Zentrum des Hochlaufs steht Fab 20 in Taiwan. Dort produziert TSMC mittlerweile 20.000 Wafer pro Monat mit der 2-Nanometer-Technologie. Entscheidend für die industrielle Bewertung ist dabei nicht nur die absolute Zahl, sondern die Zielrichtung: Als Haupttreiber nennt TSMC Kunden aus High-Performance-Computing und aus dem Bereich Künstliche Intelligenz. Damit wird der Knoten in eine Wertschöpfungsschicht eingeordnet, die stark von Energieeffizienz abhängt. Genau diese Ausrichtung erklärt, warum das Interesse an 2 Nanometern früh höher ist als bei früheren Generationen: Bei den „Tape-outs“, also den finalen Designschritten vor der Produktion, werden fast viermal so viele Projekte wie zum gleichen Zeitpunkt der Entwicklung des Vorgängerknotens 3 Nanometer verzeichnet. Dass der Sprung besonders stark ausfällt, deutet auf eine spürbar steigende Priorisierung effizienterer KI-Prozessoren hin.
Technisch betrachtet bleibt der Umsatz heute noch überwiegend bei den etablierten Knoten. TSMC liefert in der aktuellen Mischkalkulation weiterhin den größeren Anteil über 3- und 5-Nanometer-Prozesse; zusammen machen sie mehr als 60 Prozent der gesamten TSMC-Erlöse aus. Der 2-Nanometer-Anteil ist damit nicht sofort „dominant“, aber er ist strategisch relevant, weil er den Übergang in Richtung energieeffizienterer Rechen- und Beschleunigerchips unterstützt. Für die nächsten Schritte heißt das: Unternehmen, die kurzfristig noch auf reifere Knoten setzen, müssen gleichzeitig ihre Roadmaps so planen, dass Übergangsrisiken bei Verfügbarkeit und Leistungskennzahlen abgefedert werden. Der Kursverlauf zeigt indes, dass der Markt diese technologische Beschleunigung nicht automatisch mit unmittelbarer Kursstärke honoriert; kurzfristig zählt auch, wie stark Preisdruck, Kosten und Kapazitätsplanung bereits in die Guidance eingepreist sind.
Um Engpässe entlang der Lieferkette zu reduzieren, treibt TSMC neben der Fertigung auch die Advanced-Packaging-Entwicklung voran. Besonders im Fokus steht dabei „Quasi-EMIB“, eine neue Verpackungstechnologie, die direkt mit Intels Embedded Multi-die Interconnect Bridge konkurrieren soll. Der Ansatz zielt darauf ab, Kunden mehr Flexibilität beim Packaging von Hochleistungschips zu geben – und gerade Verpackung gilt als einer der Engpassfaktoren, wenn KI-Beschleuniger in großen Stückzahlen und mit komplexen Die-Kombinationen ausgeliefert werden sollen. Dabei ist nicht nur die Technologiefrage relevant, sondern auch die Kapazität: Die bestehende CoWoS-Kapazität von TSMC ist bereits bis 2026 ausgebucht. Deshalb plant der Konzern, neue Anlagen in Taiwan aufzubauen und zusätzliche Systeme in internationalen Fabriken einzubinden. Bis Ende 2026 soll die monatliche CoWoS-Kapazität auf bis zu 140.000 Wafer steigen.
Dass solche Ausbauschritte finanziell Wirkung zeigen, hängt eng mit den geplanten Preisanpassungen zusammen. Laut den Angaben befindet sich TSMC in finalen Verhandlungen über die Preise für 2027. Bei fortschrittlichen Chipknoten sollen die Erhöhungen zwischen 5 und 10 Prozent liegen, während bei einigen reiferen Technologien sogar bis zu 15 Prozent möglich sein sollen. Die Begründung verknüpft TSMC zwei Kostentreiber: gestiegene Stromkosten in Taiwan und den milliardenschweren Ausbau globaler Fertigungsstandorte. Besonders konkret wird dabei Europa, wo der Bau der ESMC-Fabrik in Dresden voranschreitet. Die Hauptbauphase ist bereits angelaufen; die Installation von Reinraumsystemen soll in der zweiten Jahreshälfte 2026 starten. Der Standort soll sich auf 16/12-Nanometer- und 28/22-Nanometer-Technologien konzentrieren und damit vor allem die europäische Automobil- und Industriebranche adressieren.
Unterm Strich entsteht so ein Bild aus drei parallelen Hebeln: schnellerer Hochlauf des 2-Nanometer-Fertigungsanteils, gezielte Erweiterung von Packaging-Kapazitäten sowie Preismodelle, die die Ausbau- und Energiekosten reflektieren sollen. Genau diese Kombination ist für den Wettbewerb gegen Intel und Samsung relevant, weil sie nicht nur Prozessfortschritt verspricht, sondern auch die Lieferfähigkeit für komplexe KI-Systeme. Gleichzeitig bleibt die Aktie kurzfristig anfällig, denn die Bewertung hängt am aktuellen Erwartungsniveau. An der Börse zeigt sich die TSMC-Aktie zuletzt schwächer: Der Kurs schloss am Freitag bei 352,00 Euro und liegt damit rund 16 Prozent unter dem 52-Wochen-Hoch von 420,50 Euro. Auf Jahressicht steht sie jedoch mit knapp 37 Prozent im Plus, was zeigt, dass der längerfristige Trend weiterhin getragen wird. Ob die Nachfrage nach fortschrittlichen Chipknoten das Tempo beim Ausbau halten kann, wird sich in den kommenden Quartalszahlen zeigen – dann wird aus dem „Umsatzbeitrag“ auch der belastbare Gradmesser für Planungssicherheit und Margenerwartungen.
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