SÜDKOREA / LONDON (IT BOLTWISE) – Intel kündigt auf dem Summit „Semiconductors Powering Humanoids“ die nächste „Razor Lake-AX“-Plattform an. Im Fokus steht ein AI-Compute von 700 TOPS direkt auf dem Chip, insbesondere für INT8/FP8-Berechnungen. Gleichzeitig ordnet Intel das SoC in eine größere Architektur ein: ein großer integrierter GPU-Teil, ein CPU-Komplex sowie eine Rückkehr von On-Package-Speicher. Unklar bleibt vorerst, wo der massive Chip gefertigt wird und wie genau die fertigungstechnische Auslegung umgesetzt wird.
Intel hat mit der Ankündigung „Razor Lake-AX“ den nächsten Schritt seiner „AX“-Chipgeneration eingeleitet und dabei eine für mobile SoCs ungewöhnlich klare Kennzahl in den Vordergrund gestellt: 700 TOPS AI-Compute auf dem Die. Als Vergleichsmaßstab nannte Intel dabei 180 TOPS für die aktuelle „Panther Lake“-Klasse sowie eine rechnerische Steigerung von 3,88 Mal im Bereich INT8/FP8. Für Anwender heißt das weniger „Marketing-Zahl“ als vielmehr: Die Rechenleistung soll stärker auf KI-Workloads zugeschnitten werden, die in der Praxis oft in genauerer Präzision (INT8) oder gemischter FP8-Logik laufen und deshalb nicht 1:1 mit klassischen CPU-Gleitkomma-Performancewerten gleichzusetzen sind. Dass der Sprung laut Intel vor allem aus einer großen integrierten GPU und einem umfangreichen CPU-Komplex gespeist wird, deutet zudem darauf hin, dass Intel seine SoC-Planung deutlich stärker über die Grafik-/AI-Engine denkt als über rein CPU-lastige Szenarien.
Technisch spannend wird die Ankündigung vor allem an der Frage, wie stark die GPU-seitige Skalierung ausfällt. Denn Intel beschreibt „Razor Lake-AX“ mit zwei Varianten, die sich offenbar über die Anzahl der iGPU-Cores unterscheiden: einmal mit 16-Core-iGPU und in einer „Flagship“-Ausprägung mit 32-Core-iGPU. Beide integrierte Grafiklösungen sollen auf Intels Xe3-Grafik-IP basieren, die bereits in „Panther Lake“ steckt. Rechnet man dieses Xe3-Fundament mit der erwarteten Leistungsrelation gegen aktuelle Arc-Designs, ergibt sich ein weiteres Signal: Intel ordnet „Razor Lake-AX“ als nahezu dreifach leistungsfähig gegenüber der Arc B390 ein, die die „PTL“-Linie antreibt. Das wäre in der Architekturlogik plausibel, weil mehr Compute-Ressourcen (mehr Shader/Execution-Einheiten im GPU-Teil) bei gleichbleibender IP-Generation meist direkt auf Training-nahe Inferenzpfade und stark parallele Operatoren einzahlt.
Intel setzt bei „Razor Lake-AX“ jedoch nicht nur auf mehr Rechenkerne, sondern adressiert auch die Speicher- und Skalierungsseite: Der Chip soll On-Package-Memory erneut einführen, nachdem Intel laut den vorliegenden Angaben zuvor den Core- Ultra-200V-„Lunar Lake“-Entwurf als letzten mit On-Package-Memory positioniert hatte. Für „Razor Lake-AX“ wird demnach wieder LPDDR5X bzw. LPDDR6 auf dem Package vorgesehen. Das ist ein wichtiger Hebel, weil der Engpass bei vielen KI-Kleinstmodellen und Multimodal-Preprocessing-Schritten häufig weniger die rohe Rechenleistung ist, sondern die Bandbreite und die Latenz zwischen Recheneinheiten und dem Speicher für Aktivierungen, Gewichte (bzw. On-Device-Caches) und Zwischenergebnisse. On-Package-DRAM kann diese Lücke verkleinern und damit den realen Durchsatz verbessern, selbst wenn Peak-TOPS-Werte „nur“ eine Teilansicht der Gesamtleistung liefern.
Damit hängt auch die Verpackungs- und Interconnect-Frage eng zusammen. Intel lässt offen, wo der Chip gefertigt wird, aber die Beschreibung der geplanten Chipgröße legt einen komplexen Package-Ansatz nahe. So wird für das GPU-Die ein Bereich von rund 162,84 mm² berichtet; dazu passt die Erwartung, dass Intel auf EMIB (Embedded Multi-die Interconnect Bridge) und Foveros 3D setzt, um mehrere Bauteile miteinander zu verschalten. In der Praxis ist das für SoC-Designs ein Balanceakt: EMIB/Foveros ermöglichen heterogene Integration und verkürzen Verbindungswege, erhöhen aber zugleich den Validierungsaufwand und die Sensitivität gegenüber Yield- und Thermik-Parametern. Ergänzend wird ein BGA-4326 Package mit 4.326 Pins erwartet, das in der Form zu Intels Xeon-typischen Packaging-Konventionen passt. Das ist besonders relevant, weil mechanische, thermische und elektrische Spezifikationen mit dem Formfaktor der Zielgeräte zusammenhängen und sich nicht beliebig „hochrechnen“ lassen.
Für die Roadmap zeigt die Ankündigung außerdem eine interessante Umordnung: Intel hatte laut den vorliegenden Berichten zuvor ein „Nova Lake-AX“-SoC mit 48 Xe3-GPU-Kernen und einem 28-Core-CPU-Cluster in Betracht gezogen, diese Pläne jedoch aufgeschoben. Konsequenz: Die „AX“-Generation soll nicht direkt mit „Nova Lake“ debütieren, sondern erst im Anschluss. Als Zielmarke nennt Intel, die ersten Chips mit dem „AX“-Suffix nach „Nova Lake“ zu starten, während „Razor Lake-AX“ für 2028 erwartet wird. Für Unternehmen und Entwickler bedeutet das vor allem Planbarkeit auf Plattformebene: Tools, Compiler-Pipelines und Inferenz-Backends (z. B. für INT8/FP8) müssen nicht nur funktional, sondern auch hinsichtlich Timing, Speicherhierarchie und Support-Levels auf die reale Hardwareausprägung ausgerichtet werden.
Aus Markt- und Ökosystemsicht ist „Razor Lake-AX“ ein Signal, dass Intel die KI-Funktionalität stärker in den Mittelpunkt der SoC-Strategie rückt. Der Vergleich mit bestehenden mobilen Plattformen („Panther Lake“ und Arc B390) zeigt den Anspruch, bei KI-Workloads nicht nur „moderate“ Zuwächse zu liefern, sondern eine neue Leistungsklasse zu etablieren. Gleichzeitig bleibt offen, wie sich die versprochenen 700 TOPS in typischen Produkteinsatzprofilen schlagen, etwa bei konstanten Leistungsgrenzen, realer Speicherbandbreite und Lastwechseln durch integrierte Display- und I/O-Funktionen. Für IT-Abteilungen und Entwicklerteams ist deshalb der nächste Schritt nicht nur ein Blick auf Benchmarks, sondern die Frage nach Referenzdesigns, SDK-/Runtime-Kompatibilität und der konkreten Auslegung der On-Device-KI-Pfade auf dem SoC. Wenn Intel das Zusammenspiel aus Xe3-GPU, On-Package-Memory und Interconnect-Technik so umsetzt, wie es die Architekturannahmen nahelegen, könnte „Razor Lake-AX“ in der Praxis ein deutlich breiteres Spektrum an KI-Funktionen in Endgeräten ermöglichen – von lokalem Medienverständnis bis hin zu effizienteren On-Device-Assistenten.
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