LONDON (IT BOLTWISE) – Der Engpass in der KI-Hardwareproduktion ist von der Wafer-Fertigung in die nächste Prozessstufe gewandert: Packaging und hochgestapelter HBM-Speicher. TSMC meldet trotz voller 3-Nanometer-Auslastung eine Nachfrage, die bei der Kapazität an ihre Grenzen stößt. Für Investoren ergibt sich daraus ein anderes Chancen-Risiko-Profil als bei der Energie-Infrastruktur. Gleichzeitig zeigt Nvidias Bilanz, wie stark Lieferzusagen und Speicherzukäufe die Knappheit in den Folgequartalen fest verdrahten.
Die Argumentationslinie dieser Analyse führt an einer Stelle weg von dem, worüber bei KI fast immer zuerst gesprochen wird: also bei welchem Prozessknoten wie viele Nanometer möglich sind. Stattdessen rückt die zweite Etage der Halbleiterkette in den Fokus, denn dort entscheidet sich, ob aus produzierte(r)m Silizium überhaupt ein lieferbarer Beschleuniger wird. In den vergangenen 18 Monaten habe sich der Flaschenhals laut der Darstellung „zwei Schritte weiter“ verschoben – von der Belichtung des Wafers hin zum Zusammenbau von Rechenkern und Speicher. Damit wird aus einem eher planbaren Fertigungsproblem eine Engpasslogik, die stark von Packaging-Kapazitäten und dem verfügbaren HBM-Angebot abhängt.
Technisch bedeutet das konkret: CoWoS ist das Packaging-Verfahren, mit dem TSMC Rechenkern und Speicherstapel auf einem gemeinsamen Träger vereint. Der zweite Baustein ist HBM selbst – hochgestapelte Speicherchips, die direkt neben dem Rechenkern sitzen und damit sehr hohe Speicherbandbreite liefern. Beide Ressourcen sind heute knapper als das Silizium, aus dem sie bestehen. Und genau hier liegt der wesentliche Unterschied zur Energie-„Etage“, die in der Reihe zuvor beschrieben wurde: Wenn Hyperscaler dort Kapazitäten für Netzausbau oder Stromersatz einkaufen, können Verzögerungen eher über Zeiträume geglättet werden. Bei CoWoS und HBM gibt es jedoch keinen vergleichbaren zweiten Abnehmer, der kurzfristig einspringt, falls Budgets gekürzt werden – die gesamte Kette hängt an einer einzigen Nachfragewelle.
Die wirtschaftliche Konsequenz wird in den Zahlen festgemacht. TSMC nennt für das zweite Quartal eine Bruttomarge von 67,7 Prozent; der Nettogewinn stieg um 77,4 Prozent auf einen Quartalsrekord. Gleichzeitig meldet der Chiphersteller ein stark nach oben angepasstes Investitionsbudget: Im Januar war von 52 bis 56 Milliarden Dollar die Rede, im April wurde die Spanne präzisiert und im Juli auf 60 bis 64 Milliarden Dollar angehoben. Ergänzend kommt ein mehrjähriges Programm über mehr als 100 Milliarden Dollar für Arizona hinzu. Dass ein Unternehmen sein größtes Budget der Firmengeschichte innerhalb weniger Monate zweimal nach oben korrigiert, ist in der Logik dieser Darstellung weniger „optimistisch“ als ein Indikator für eine weiterhin angespannte Auftragslage. Für das dritte Quartal erwartet TSMC 44,6 bis 45,8 Milliarden Dollar Umsatz sowie 65 bis 67 Prozent Bruttomarge; der Rückgang werde unter anderem durch den Hochlauf der 2-Nanometer-Fertigung erklärt.
Damit die Engpassstelle eindeutig wird, nennt die Analyse auch konkrete Angebots- und Warteschlangenwerte. Für CoWoS halte TSMC nach Branchenschätzungen mehr als 90 Prozent der weltweiten Kapazität, während die Lieferzeiten der Packaging-Werke mit 52 bis 78 Wochen angegeben werden. Die Buchungen reichten bis 2027; zudem wird genannt, dass Nvidia allein rund 60 Prozent der Kapazität belegt haben soll. Auf der Kapazitätsseite wird ein Wachstumspfad skizziert: von etwa 35.000 Wafern pro Monat Ende 2024 auf rund 75.000 Ende 2025, mit Ziel 125.000 bis 130.000 zum Jahresende 2026. Die „Lücke“ zwischen Nachfrage und Angebot soll sich zwar verringern, aber den Prognosen zufolge nicht verschwinden. Beim Speicher zeichnet sich ein ähnliches Bild: Für die geforderte HBM-Qualität gebe es weltweit im Kern drei Anbieter – SK Hynix, Samsung und Micron – deren Kapazität für 2026 als ausverkauft gilt; für HBM4 wird der Serienstart bei SK Hynix im zweiten Quartal erwähnt.
Besonders greifbar wird die Knappheit an einer Beispielrechnung zur nächsten Beschleunigergeneration. Nvidias neue Generation Vera Rubin, deren Produktionsauslieferungen Anfang August beginnen sollen, benötigt pro Beschleuniger acht HBM4-Stapel mit zusammen 288 Gigabyte. Wenn alle drei Hersteller für diese Konfiguration qualifiziert sind, fällt der Großteil der Zuteilung auf den süd-koreanischen Marktführer; der Rest entfällt auf Samsung und Micron. Diese Logik ist weniger ein „Wunschkonzert“ als eine Zuteilungsrechnung: Wer die Ausbringung von Rubin prognostiziert, prognostiziert im Kern die Ausbringung mehrerer HBM4-Fabriken. Dass diese Engpassstelle auch in den Margen sichtbar ist, passt zur Argumentation: In der Speicherbranche seien operative Margen von mehr als 70 Prozent bislang historisch selten gewesen – die Darstellung deutet das als Indiz für das Ende eines alten Zyklenmusters und für einen Zustand, in dem Nachfrage und Lieferfähigkeit gleichzeitig stark begrenzt sind.
Der Blick auf Bestellungen und nicht nur auf Produktionsauslieferungen liefert dabei den wahrscheinlich praxisnächsten Hinweis. Broadcom meldete für das zweite Geschäftsquartal einen KI-Halbleiterumsatz von 10,8 Milliarden Dollar, plus 143 Prozent, während Bestellungen von mehr als 30 Milliarden Dollar eingingen – also deutlich oberhalb dessen, was ausgeliefert wurde. Konzernchef Hock Tan wird so beschrieben, dass große Kunden nicht für die sofortige Lieferung bestellen, sondern wegen der benötigten Vorlaufzeit für Wafer, HBM und sogar Strom. Dadurch schließt sich der Kreis zur zuvor erwähnten „Engpasslogik“: Dieselben Einkäufer, die bei anderen Infrastrukturprojekten Kapazitäten reservieren, sichern sich gleichzeitig Chip-Produktionsfähigkeit. Auf der anderen Bilanzseite zeigt dann Nvidia, wie Verbindlichkeiten die Knappheit fixieren: Die lieferbezogenen Verpflichtungen lagen Ende April (Ende des ersten Quartals des Geschäftsjahres 2027) bei 119 Milliarden Dollar; bis zum Ende des zweiten Quartals des Geschäftsjahres 2027 sollen sie binnen drei Monaten auf 279 Milliarden Dollar gestiegen sein, im Wesentlichen durch den Einkauf von Speicher. Damit wird aus einer Engpassthese eine Bilanzrealität.
Warum diese Kette so schnell wachsen kann, liefert die Darstellung schließlich über das „Token“-Prinzip. Ein Sprachmodell zerlegt Eingaben und Ausgaben in Token; abgerechnet wird pro Token. Ein Rechenzentrum produziert damit nicht nur „Rechenzeit“, sondern eine zählbare Stückzahl mit Stückpreis, und Agenten erhöhen den Rechenbedarf in vielen Fällen deutlich, weil sie Werkzeuge aufrufen, Zwischenresultate prüfen und wiederholen. Dazu kommt, dass Nvidia den Umsatz pro verkauftem Gigawatt Rechenzentrum deutlich beschreibt, und dass steigender Durchsatz sowie fallende Token-Kosten nach dieser Logik Nachfrage nicht dämpfen, sondern neue Anwendungsfälle erst wirtschaftlich machen. Für die nächsten Quartale verdichtet sich daraus ein Prüfstein: Wenn Nvidias Bruttomarge trotz Speicherpreissteigerungen wie angekündigt sinkt und gleichzeitig die Lieferverpflichtungen weiter steigen, bleibt der Engpass in der Chip-Schicht für den Markt spürbar. Kurz gesagt: In der Energie-„Etage“ kaufen Unternehmen eher Zeit, in der Chip-„Etage“ kaufen sie Hebel – und genau deshalb unterscheidet sich auch das Risiko, wenn ein Nachfragezyklus kippt.
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