LONDON (IT BOLTWISE) – Bei TSMC stauen sich fertige A20-Pro-Chips im Wert von rund einer Milliarde US-Dollar, weil DRAM-Bausteine für das Packaging fehlen. Dadurch geraten der geplante Verkaufsstart des iPhone 18 Pro und Apples erste faltbare Geräte in Verzug. Als Engpassverstärker gelten reservierte DRAM-Kapazitäten bis weit in das Jahr 2027, während gleichzeitig die Produktionsplanung für bis zu 200 Millionen Geräte für die nächste Generation unter Druck gerät. Parallel treibt TSMC die KI-nahe Speicher- und Verbindungstechnologie mit Co-Packaged Optics voran, um künftige Rechenlast effizienter zu bedienen.

Der Engpass sitzt nicht im Wafer, sondern am Übergang zum fertigen Bauteil: Bei TSMC lagern nach Angaben aus Marktberichten derzeit fertige Prozessoren im Wert von rund einer Milliarde US-Dollar, für die offenbar noch DRAM-Speicherbausteine fehlen. Genannt werden A20-Pro-Chips, deren Auslieferung durch die akute Knappheit bei DRAM blockiert wird. Für das finale Packaging sind diese Speicherkomponenten zwingend erforderlich, sodass sich die bereits produzierten Wafer in den Lagern des taiwanischen Auftragsfertigers stapeln. Genau dieser „letzte Kilometer“ entscheidet in solchen Lieferketten oft schneller über Termine als die reine Chip-Fertigungskapazität.
Die Folge wirkt direkt auf Apples Roadmap: Der geplante Verkaufsstart des iPhone 18 Pro sowie Apples erste Faltgeräte soll für September anstehen, doch die aktuelle Versorgungslage bei DRAM setzt diesen Zeitplan unter Druck. Der Analyst Tim Culpan wird in der Berichterstattung so zitiert bzw. eingeordnet, dass die Stapelbildung entsteht, weil die notwendigen Packaging-Kapazitäten ohne die Speicherbausteine nicht genutzt werden können. Besonders brisant ist dabei die Planungsseite beim Volumen: Apple peilt laut den Angaben eine Stückzahl von insgesamt 200 Millionen Einheiten für die kommende Geräterunde an. Wenn der Engpass in einem „Kritischen Pfad“ liegt, reicht schon eine moderate Verzögerung, um mehrere Prozessschritte zu entkoppeln – und damit auch den Takt für Supply-Chain-nahe Vorproduktionen der Systempartner.
Der DRAM-Stau wird außerdem als Symptom einer breiteren Angebotspriorisierung beschrieben. Aus der Berichterstattung geht hervor, dass Hersteller wie Micron ihre Kapazitäten bis weit in das Jahr 2027 für Server-Anwendungen reserviert haben. Damit verschiebt sich die Verfügbarkeit von DRAM weg von mobilen Endgeräten, obwohl Apple und andere Smartphone-Hersteller ihre Chips typischerweise über Advanced-Packaging-Workflows möglichst eng mit Speicher- und Schnittstellenanforderungen verheiraten. Parallel beobachten Zulieferer wie Foxconn und BYD die Bestandsentwicklung bei den A20-Pro-Chips genau, weil Verzögerungen bei der Chip-Zustellung unmittelbar auf die Endfertigung der nächsten Smartphone-Generation durchschlagen. Selbst wenn die Produktankündigungen bereits in Kalendern angelegt sind – in den Angaben wird etwa eine iPhone-Keynote am 9. September 2026 sowie ein Release am 18. September 2026 genannt – bleibt die kurzfristige Entspannung des DRAM-Engpasses die kritische Variable.
Während die Logistik-Frage die Veröffentlichungstermine betrifft, spiegelt sich die Marktseite in einer spürbaren Sektor-Rotation: Die TSMC-Aktie stand zuletzt im Zentrum einer breiteren Korrektur im Halbleitersektor. Der VanEck Semiconductor ETF verzeichnete in der vergangenen Woche einen Rückgang von vier Prozent, und TSMC wurde dabei als einer der Treiber genannt. Im deutschen Handel schloss das Papier am Freitag bei 363,00 Euro. Trotz der kurzfristigen Schwäche liegt der Wert seit Jahresbeginn um 41,25 Prozent im Plus. Diese Kombination aus Fundamentalkrisen im „Packaging-to-Delivery“-Übergang und gleichzeitig vorsichtiger Bewertung am Aktienmarkt erklärt, warum Investoren in solchen Phasen besonders auf Indikatoren rund um KI-Infrastrukturlast achten, etwa auf die Mietpreise für Rechenzentrums-Hardware.
Ein weiterer Belastungsfaktor für das Sentiment ist laut den Berichten die Erwartung einer Abkühlung im KI-Sektor: Medienberichten zufolge seien die Mietpreise für NVIDias B200-Chips innerhalb weniger Wochen um rund 30 Prozent gefallen. Marktbeobachter bewerten die Lage für TSMC dennoch differenzierter, weil die Aktie zwar rund 13,67 Prozent unter ihrem 52-Wochen-Hoch notiert, das Kurs-Gewinn-Verhältnis jedoch mit 27,7x weiterhin deutlich unter dem Branchendurchschnitt von etwa 50,9x liegt. Für die Bewertung ist das relevant, weil DRAM-Engpässe zwar kurzfristig Output und Umsatzerkennung verschieben können, die zugrunde liegende Wettbewerbsfähigkeit jedoch oft stärker von Stack-Entscheidungen abhängt. Genau dort setzt TSMC gleichzeitig an: Neben der operativen Lieferkette wird auch technologisch an einer Beschleunigung der Datenübertragung gearbeitet.
Technisch betrachtet bleibt die Strategie rund um Advanced Packaging und neue Interconnect-Ansätze der zentrale Hebel, um künftige KI-Last effizienter zu verarbeiten. In der Berichterstattung heißt es, TSMC setze verstärkt auf Co-Packaged Optics (CPO), um Energieeffizienz und Rechengeschwindigkeit bei KI-Anwendungen zu steigern. Konkret wird die COUPE-Technologie in Verbindung mit dem etablierten CoWoS-Verfahren genannt. Das adressiert ein klassisches Problem großer KI-Systeme: Nicht nur die Rechenleistung des Prozessors ist limitierend, sondern auch die Bandbreite und der Energiebedarf der Verbindung zwischen Chips, Speicher und Beschleunigern. Daneben soll damit auch die Erwartung rund um den weltweiten Halbleiterumsatz von etwa 1,5 Billionen US-Dollar im Jahr 2026 adressiert werden – eine Zielmarke, die in der Praxis stark davon abhängt, ob Packaging- und Interconnect-Engpässe wie der aktuelle DRAM-Stau wieder in einen planbaren Rhythmus zurückfinden.
Für Unternehmen, die auf TSMC- und Packaging-Ökosysteme angewiesen sind, verschiebt sich damit die operative Priorität: kurzfristig wird das Risiko eines „Komponenten-Transports“ über die letzten Schritte der Fertigung sichtbar, mittelfristig gewinnt die Ausrichtung auf skalierbare Packaging- und Optikpfade an Gewicht. Wenn sich der DRAM-Engpass bei TSMC nicht rechtzeitig entspannt, wirkt sich das nicht nur auf einzelne Apple-Produkte aus, sondern kann auch die Auslieferungstakte anderer Kunden beeinflussen, die ähnliche Memory- und Packaging-Abhängigkeiten haben. Gleichzeitig ist die technologische Ausrichtung auf CPO und die Weiterentwicklung von CoWoS als Grundlage für hochintegrierte Rechenlösungen ein Signal, dass TSMC die KI-nahe Nachfrage nicht nur prognostiziert, sondern die Lieferkette und das Design-Ökosystem aktiv mit neueren Verbindungsarchitekturen unterfüttert.
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